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參數(shù)資料
| 型號： | M5LV-128/68-7VC |
| 廠商： | Lattice Semiconductor Corporation |
| 文件頁數(shù)： | 4/42頁 |
| 文件大小： | 0K |
| 描述： | IC CPLD 128MC 68I/O 100TQFP |
| 標準包裝： | 90 |
| 系列： | MACH® 5 |
| 可編程類型： | 系統(tǒng)內(nèi)可編程 |
| 最大延遲時間 tpd(1)： | 7.5ns |
| 電壓電源 - 內(nèi)部： | 3 V ~ 3.6 V |
| 宏單元數(shù)： | 128 |
| 輸入/輸出數(shù)： | 68 |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 100-LQFP |
| 供應商設備封裝： | 100-TQFP（14x14） |
| 包裝： | 托盤 |
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12
MACH 5 Family
SECURITY BIT
A programmable security bit is provided on the MACH 5 devices as a deterrent to unauthorized copying of
the array configuration patterns. Once programmed, this bit defeats readback of the programmed pattern by
a device programmer, securing proprietary designs from competitors. Programming and verification are also
defeated by the security bit. The bit can only be reset by erasing the entire device.
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相關PDF資料 |
PDF描述 |
|---|---|
| M5LV-128/68-10VI | IC CPLD 128MC 68I/O 100TQFP |
| VE-B4N-CY-F3 | CONVERTER MOD DC/DC 18.5V 50W |
| EBA15DTMN | CONN EDGECARD 30POS R/A .125 SLD |
| M5-128/68-7YC/1 | IC CPLD ISP 128MC 68IO 100PQFP |
| VE-B4N-CY-F2 | CONVERTER MOD DC/DC 18.5V 50W |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
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| M5LV-256/104-10AI | 制造商:LATTICE 制造商全稱:Lattice Semiconductor 功能描述:Fifth Generation MACH Architecture |
| M5LV-256/104-10HC | 制造商:LATTICE 制造商全稱:Lattice Semiconductor 功能描述:Fifth Generation MACH Architecture |
| M5LV-256/104-10HI | 制造商:LATTICE 制造商全稱:Lattice Semiconductor 功能描述:Fifth Generation MACH Architecture |
| M5LV-256/104-10VC | 功能描述:CPLD - 復雜可編程邏輯器件 PROGRAM HI DENSITY CPLD RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數(shù)量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100 |
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