參數(shù)資料
型號： M5LV-320/160-7YC
廠商： Lattice Semiconductor Corporation
文件頁數(shù)： 10/42頁
文件大?。?/td> 0K
描述： IC CPLD 320MC 160I/O 208PQFP
標(biāo)準(zhǔn)包裝： 24
系列： MACH® 5
可編程類型： 系統(tǒng)內(nèi)可編程
最大延遲時間 tpd(1)： 7.5ns
電壓電源 - 內(nèi)部： 3 V ~ 3.6 V
宏單元數(shù)： 320
輸入/輸出數(shù)： 160
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 208-BFQFP
供應(yīng)商設(shè)備封裝： 208-PQFP（28x28）
包裝： 托盤
18
MACH 5 Family
BLOCK DIAGRAM — M5(LV)-384/XXX
Macrocells
64
x
73
AND
Logic
Array
and
Logic
Allocator
Control
Generator
64
PT
2
PT
OE
I/O
Cells
16
32
7
PT
7
2
32
16
Macrocells
64
x
73
AND
Logic
Array
and
Logic
Allocator
Control
Generator
64
PT
2
PT
OE
I/O
Cells
16
32
7
PT
7
2
32
16
Macrocells
Control
Generator
64
PT
2
PT
OE
16
32
7
PT
7
2
32
16
I/O
Cells
64
x
73
AND
Logic
Array
and
Logic
Allocator
Macrocells
Control
Generator
64
PT
2
PT
OE
16
32
7
PT
7
2
32
16
I/O
Cells
64
x
73
AND
Logic
Array
and
Logic
Allocator
Block
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Block
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0-15
Block
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0-15
Block
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0-15
Block
Interconnect
Macrocells
64
x
73
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Logic
Array
and
Logic
Allocator
Control
Generator
64
PT
2
PT
OE
I/O
Cells
16
32
7
PT
7
2
32
16
Macrocells
64
x
73
AND
Logic
Array
and
Logic
Allocator
Control
Generator
64
PT
2
PT
OE
I/O
Cells
16
32
7
PT
7
2
32
16
Macrocells
Control
Generator
64
PT
2
PT
OE
16
32
7
PT
7
2
32
16
I/O
Cells
64
x
73
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Logic
Array
and
Logic
Allocator
Macrocells
Control
Generator
64
PT
2
PT
OE
16
32
7
PT
7
2
32
16
I/O
Cells
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x
73
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Logic
Array
and
Logic
Allocator
Block
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Block
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Block
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Block
Interconnect
Macrocells
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x
73
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Logic
Array
and
Logic
Allocator
Control
Generator
64
PT
2
PT
OE
I/O
Cells
16
32
7
PT
7
2
32
16
Macrocells
64
x
73
AND
Logic
Array
and
Logic
Allocator
Control
Generator
64
PT
2
PT
OE
I/O
Cells
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32
7
PT
7
2
32
16
Macrocells
Control
Generator
64
PT
2
PT
OE
16
32
7
PT
7
2
32
16
I/O
Cells
64
x
73
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Logic
Array
and
Logic
Allocator
Macrocells
Control
Generator
64
PT
2
PT
OE
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32
7
PT
7
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32
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Cells
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x
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Logic
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Block
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Interconnect
Macrocells
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x
73
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Logic
Array
and
Logic
Allocator
Control
Generator
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PT
2
PT
OE
I/O
Cells
16
32
7
PT
7
2
32
16
Macrocells
64
x
73
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Logic
Array
and
Logic
Allocator
Control
Generator
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PT
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OE
I/O
Cells
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32
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PT
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32
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Macrocells
Control
Generator
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PT
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PT
OE
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32
7
PT
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32
16
I/O
Cells
64
x
73
AND
Logic
Array
and
Logic
Allocator
Macrocells
Control
Generator
64
PT
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PT
OE
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32
7
PT
7
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I/O
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x
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Logic
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Logic
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Block
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Block
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Block
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Interconnect
S
E
G
M
E
N
T
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CLK1
CLK2
CLK3
4
SEGMENT
0
SEGMENT
5
SEGMENT
2
SEGMENT
1
I 0
I 1
I 2
Macrocells
64
x
73
AND
Logic
Array
and
Logic
Allocator
Control
Generator
64
PT
2
PT
OE
I/O
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32
7
PT
7
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32
16
Macrocells
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x
73
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Logic
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and
Logic
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Control
Generator
64
PT
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PT
OE
I/O
Cells
16
32
7
PT
7
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32
16
Macrocells
Control
Generator
64
PT
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PT
OE
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32
7
PT
7
2
32
16
I/O
Cells
64
x
73
AND
Logic
Array
and
Logic
Allocator
Macrocells
Control
Generator
64
PT
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PT
OE
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32
7
PT
7
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16
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x
73
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Logic
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Block
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0-15
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IN
T
E
R
C
O
N
E
C
T
SEGMENT
3
Macrocells
64
x
73
AND
Logic
Array
and
Logic
Allocator
Control
Generator
64
PT
2
PT
OE
I/O
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32
7
PT
7
2
32
16
Macrocells
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x
73
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Logic
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Logic
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PT
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32
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32
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Macrocells
Control
Generator
64
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PT
OE
16
32
7
PT
7
2
32
16
I/O
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64
x
73
AND
Logic
Array
and
Logic
Allocator
Macrocells
Control
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64
PT
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PT
OE
16
32
7
PT
7
2
32
16
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64
x
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參數(shù)描述
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M5LV-384/120-12YI 功能描述:CPLD - 復(fù)雜可編程邏輯器件 PROGRAM HI DENSITY CPLD RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池?cái)?shù)量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100
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