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參數(shù)資料
| 型號： | M7A3P400-FG256I |
| 元件分類： | FPGA |
| 英文描述： | FPGA, 400000 GATES, 350 MHz, PBGA256 |
| 封裝： | 1 MM PITCH, FBGA-256 |
| 文件頁數(shù)： | 198/246頁 |
| 文件大小： | 3010K |
| 代理商： | M7A3P400-FG256I |
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ProASIC3/E Flash Family FPGAs
v2.1
2-43
5 V Output Tolerance
ProASIC3 I/Os must be set to 3.3 V LVTTL or 3.3 V LVCMOS
mode to reliably drive 5 V TTL receivers. It is also critical
that there be NO external I/O pull-up resistor to 5 V, since
this resistor would pull the I/O pad voltage beyond the
3.6 V absolute maximum value, and consequently cause
damage to the I/O.
When set to 3.3 V LVTTL or 3.3 V LVCMOS mode,
ProASIC3 I/Os can directly drive signals into 5 V TTL
receivers. In fact, VOL = 0.4 V and VOH = 2.4 V in both
3.3 V LVTTL and 3.3 V LVCMOS modes exceeds the
VIL =0.8 V and VIH = 2 V level requirements of 5 V TTL
receivers. Therefore, level '1' and level '0' will be
recognized correctly by 5 V TTL receivers.
Simultaneous Switching Outputs (SSOs)
and Printed Circuit Board Layout
SSOs can cause signal integrity problems on adjacent
signals that are not part of the SSO bus. Both inductive
and capacitive coupling parasitics of bond wires inside
packages and of traces on PCBs will transfer noise from
SSO busses onto signals adjacent to those busses.
Additionally, SSOs can produce ground bounce noise and
VCCI dip noise. These two noise types are caused by
rapidly changing currents through GND and VCCI
package pin inductances during switching activities
Ground bounce noise voltage = L(GND) × di/dt
EQ 2-1
VCCI dip noise voltage = L(VCCI) × di/dt
EQ 2-2
Any group of four or more input pins switching on the
same clock edge is considered an SSO bus. The shielding
should be done both on the board and inside the
package unless otherwise described.
In-package shielding can be achieved in several ways; the
required shielding will vary depending on whether pins
next
to
the
SSO
bus
are
LVTTL/LVCMOS
inputs,
LVTTL/LVCMOS outputs, or GTL/SSTL/HSTL/LVDS/LVPECL
inputs and outputs. Board traces in the vicinity of the
SSO bus have to be adequately shielded from mutual
coupling and inductive noise that can be generated by
the SSO bus. Also, noise generated by the SSO bus needs
to be reduced inside the package.
PCBs perform an important function in feeding stable
supply voltages to the IC and, at the same time,
maintaining signal integrity between devices.
Key issues that need to considered are as follows:
Power and ground plane design and decoupling
network design
Transmission line reflections and terminations
相關PDF資料 |
PDF描述 |
|---|---|
| M7A3P400-FG256 | FPGA, 400000 GATES, 350 MHz, PBGA256 |
| M7A3P400-FG484I | FPGA, 400000 GATES, 350 MHz, PBGA484 |
| M7A3P400-FG484 | FPGA, 400000 GATES, 350 MHz, PBGA484 |
| M7A3P400-FGG144I | FPGA, 400000 GATES, 350 MHz, PBGA144 |
| M7A3P400-FGG144 | FPGA, 400000 GATES, 350 MHz, PBGA144 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| M7A5 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:MEDIUM CURRENT SILICON RECTIFIERS |
| M7A9 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:MEDIUM CURRENT SILICON RECTIFIERS |
| M7AFS600-1FG256 | 制造商:Microsemi Corporation 功能描述:FPGA FUSION 600K GATES 1282.05MHZ 130NM 1.5V 256FBGA - Trays 制造商:Microsemi SOC Products Group 功能描述:FPGA FUSION 600K GATES 1282.05MHZ 130NM 1.5V 256FBGA - Trays |
| M7AFS600-1FG256ES | 制造商:ACTEL 制造商全稱:Actel Corporation 功能描述:Actel Fusion Mixed-Signal FPGAs |
| M7AFS600-1FG256I | 制造商:Microsemi Corporation 功能描述:FPGA FUSION 600K GATES 1282.05MHZ 130NM 1.5V 256FBGA - Trays 制造商:Microsemi SOC Products Group 功能描述:FPGA FUSION 600K GATES 1282.05MHZ 130NM 1.5V 256FBGA - Trays |
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