參數(shù)資料
型號(hào)： MAX31782ETL+
廠商： Maxim Integrated Products
文件頁(yè)數(shù)： 7/20頁(yè)
文件大?。?/td> 0K
描述： IC MICROCONTROLLER 40TQFN
產(chǎn)品培訓(xùn)模塊： Lead (SnPb) Finish for COTS
Obsolescence Mitigation Program
標(biāo)準(zhǔn)包裝： 1
系列： MAXQ®
應(yīng)用： 系統(tǒng)管理
核心處理器： MAXQ20
程序存儲(chǔ)器類型： 閃存（64 kB），ROM（8 kB）
RAM 容量： 1K x 16
接口： I²C，SM 總線
輸入/輸出數(shù)： 5
電源電壓： 2.7 V ~ 5.5 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 40-WFQFN 裸露焊盤
包裝： 管件
供應(yīng)商設(shè)備封裝： 40-TQFN-EP（6x6）
其它名稱： 90-31782+T00
MAX31782
System Management Microcontroller
15
PWM Outputs
The device provides six independent PWM outputs. Each
PWM output is associated with four SFRs: PWMCNn,
PWMVn, PWMRn, and PWMCn, where n = 0–5 is the
channel number. The PWM clock is derived from the
system clock with a division ratio defined by PWMCNn.
The PWMCNn register also enables/disables the PWM
output and selects the PWM polarity. The user can set
the frequency and the duty cycle of each PWM output
individually by configuring the corresponding PWMRn
register and the PWMCn register, respectively.
When the PWM output functionality of a PWM.n pin is
disabled, that pin can be used as a GPIO. When used
as GPIO pins, PWM.n pins are accessed as Port 1 and
through three SFRs: PO1, PI1, and PD1. Each PWM.n pin
can be independently configured, and can be defined
as an input with weak pullup, an input without pullup, or
an output.
Table 2. I/O Port Pins
Figure 4. Port 6 I/O Block Diagram
PD6.n
SF DIRECTION
SF ENABLE
MUX
PO6.n
VDD
SF OUTPUT
VDD
WEAK
I/O PAD
P6.n
INTERRUPT
FLAG
PI6.n OR SF INPUT
n = 04
EIES6.n
DETECT
CIRCUIT
EIE6.n
MAX31782
PORT INDEX
PRIMARY
FUNCTION
ALTERNATE
FUNCTION
INTERRUPTS
TAP (JTAG)
RESET STATE
P6.0
GPIO, P6.0
—
INT0
TCK
P6.1
GPIO, P6.1
—
INT1
TDI
P6.2
GPIO, P6.2
Timer B TBB Pin
INT2
TMS
P6.3
GPIO, P6.3
—
INT3
TDO
P6.4
GPIO, P6.4
Timer B TBA Pin
INT4
—
GPIO input with
weak pullup
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