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參數(shù)資料
| 型號(hào)： | MAX3872ETJ+T |
| 廠商： | Maxim Integrated Products |
| 文件頁數(shù)： | 13/15頁 |
| 文件大小： | 0K |
| 描述： | IC DATA RECOVERY W/AMP 32-TQFN |
| 產(chǎn)品培訓(xùn)模塊： | Lead (SnPb) Finish for COTS Obsolescence Mitigation Program |
| 標(biāo)準(zhǔn)包裝： | 2,500 |
| 類型： | 時(shí)鐘和數(shù)據(jù)恢復(fù)（CDR），多路復(fù)用器 |
| PLL： | 是 |
| 主要目的： | 以太網(wǎng)，SONET/SDH |
| 輸入： | CML |
| 輸出： | CML |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:2 |
| 差分 - 輸入:輸出： | 是/是 |
| 頻率 - 最大： | 2.67GHz |
| 電源電壓： | 3 V ~ 3.6 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 32-WFQFN 裸露焊盤 |
| 供應(yīng)商設(shè)備封裝： | 32-TQFN-EP（5x5） |
| 包裝： | 帶卷 (TR) |
MAX3872
Multirate Clock and Data Recovery
with Limiting Amplifier
_______________________________________________________________________________________
7
Pin Description
PIN
NAME
FUNCTION
1, 4, 27
VCC
+3.3V Supply Voltage
2
SDI+
Positive Serial Data Input, CML
3
SDI-
Negative Serial Data Input, CML
5
SLBI+
Positive System Loopback Input or Reference Clock Input, CML
6
SLBI-
Negative System Loopback Input or Reference Clock Input, CML
7
SIS
Signal Selection Input, LVTTL. Set low for normal operation, set high for system loopback.
8
LREF
Lock to Reference Clock Input, LVTTL. Set high for PLL lock to serial data, set low for PLL lock to
reference clock.
9
LOL
Loss-of-Lock Output, LVTTL. Active low.
10, 11, 16,
25, 32
GND
Supply Ground
12
FIL
PLL Loop Filter Capacitor Input. Connect a 0.82F capacitor between FIL and VCC_VCO.
13, 18
VCC_VCO
+3.3V Supply Voltage for the VCO
14
RS1
Multirate Select Input 1, LVTTL (Table 2)
15
RS2
Multirate Select Input 2, LVTTL (Table 2)
17
RATESET
VCO Frequency Select Input, LVTTL (Table 2)
19
SCLKO-
Negative Serial Clock Output, CML
20
SCLKO+
Positive Serial Clock Output, CML
21, 24
VCC_OUT
+3.3V Supply Voltage for the CML Outputs
22
SDO-
Negative Serial Data Output, CML
23
SDO+
Positive Serial Data Output, CML
26
FREFSET
Reference Clock Frequency Select Input, LVTTL (Tables 2 and 3)
28
CAZ+
Positive Capacitor Input for DC-Offset Cancellation Loop. Connect a 0.1F capacitor between CAZ+
and CAZ-.
29
CAZ-
Negative Capacitor Input for DC-Offset Cancellation Loop. Connect a 0.1F capacitor between CAZ+
and CAZ-.
30
VREF
+2.2V Bandgap Reference Voltage Output. Optionally used for threshold adjustment.
31
VCTRL
Analog Control Input for Threshold Adjustment. Connect to VCC to disable threshold adjust.
EP
Exposed
Pad
Ground. The exposed pad must be soldered to the circuit board ground for proper thermal and
electrical performance.
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