參數資料
型號： MAX3873A
廠商： Maxim Integrated Products, Inc.
英文描述： 16-Channel LVDM Transceiver 64-TSSOP -40 to 85
中文描述： 低功耗、結構緊湊的2.5Gbps/2.7Gbps時鐘恢復與數據再定時IC
文件頁數： 3/12頁
文件大?。?/td> 793K
代理商： MAX3873A
M
Low-Power, Compact 2.5Gbps or 2.7Gbps
Clock-Recovery and Data-Retiming IC
_______________________________________________________________________________________
3
AC ELECTRICAL CHARACTERISTICS
(V
CC
= 3.0V to 3.6V, C
F
= 0.022μF, T
A
= -40°C to +85°C. Typical values are at V
CC
= 3.3V, 2.488Gbps, T
A
= +25°C, unless otherwise
noted.) (Note 4)
PARAMETER
SYMBOL
CONDITIONS
MIN
TYP
2.488
2.67
MAX
UNITS
RATESET = low
RATESET = high
Figure 2 (Note 5)
f
≤
2MHz
RATESET = Low
Serial Input Data Rate
Gbps
Clock-to-Q Delay
Jitter Peaking
Jitter Transfer Bandwidth
t
CLK-Q
J
P
J
BW
-70
+70
0.1
2.0
ps
dB
MHz
f = 70kHz, 0.4UI deterministic jitter
on input data
6.9
f = 100kHz, 0.4UI deterministic jitter
on input data
2.12
4.5
f = 1MHz, 0.4UI deterministic jitter
on input data
0.33
0.6
(Notes 6, 8)
f = 10MHz, 0.4UI deterministic jitter
on input data
0.15
0.3
f = 70kHz, 0.4UI deterministic jitter
on input data
6.9
f = 100kHz, 0.4UI deterministic jitter
on input data
2.12
4.5
f = 1MHz, 0.4UI deterministic jitter
on input data
0.33
0.6
Sinusoidal Jitter Tolerance
(Notes 6, 9)
f = 10MHz, 0.37UI deterministic jitter
on input data
0.15
0.3
UI
P-P
5
45
6
40
6.8
62
7.65
86
mUI
RMS
mUI
P-P
mUI
RMS
mUI
P-P
(Notes 7, 8)
Jitter Generation
J
GEN
(Notes 7, 9)
Clock Output Edge
Speed
20% to 80%
60
110
ps
Data Output Edge
Speed
20% to 80%
60
110
ps
Tolerated Consecutive
Identical Digits
2000
bits
100kHz to 2.5GHz
2.5GHz to 4.0GHz
17
14
SDI± Input Return Loss
(-20log(
S
11
))
dB
Frequency Acquisition
Time
Figure 4
1
ms
μs
LOL
Assert Time
Figure 4
1.6
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