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參數(shù)資料
| 型號： | MAX9851ETM+ |
| 廠商： | Maxim Integrated Products |
| 文件頁數(shù)： | 18/71頁 |
| 文件大小： | 0K |
| 描述： | IC CODEC AUDIO STEREO 48TQFN-EP |
| 標準包裝： | 43 |
| 類型： | 立體聲音頻 |
| 數(shù)據(jù)接口： | 串行 |
| 分辨率（位）： | 18 b |
| ADC / DAC 數(shù)量： | 2 / 2 |
| 三角積分調(diào)變： | 是 |
| S/N 比，標準 ADC / DAC (db)： | 81.5 / 88 |
| 動態(tài)范圍，標準 ADC / DAC (db)： | 82 / 87.5 |
| 電壓 - 電源，模擬： | 2.6 V ~ 3.3 V |
| 電壓 - 電源，數(shù)字： | 1.7 V ~ 3.3 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 48-WFQFN 裸露焊盤 |
| 供應商設備封裝： | 48-TQFN-EP（7x7） |
| 包裝： | 管件 |
| 產(chǎn)品目錄頁面： | 1392 (CN2011-ZH PDF) |
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MAX9851/MAX9853
Stereo Audio CODECs with Microphone, DirectDrive
Headphones, Speaker Amplifiers, or Line Outputs
______________________________________________________________________________________
25
Pin Description (continued)
PIN
MAX9851
MAX9853
NAME
FUNCTION
21
C1N
Charge-Pump Flying Capacitor Negative Terminal. Connect a 0.22F ceramic capacitor
between C1N and C1P.
22
CPGND
Charge-Pump Ground
23
C1P
Charge-Pump Flying Capacitor Positive Terminal. Connect a 0.22F ceramic capacitor
between C1N and C1P.
24
CPVDD
Charge-Pump Positive Power-Supply Input. Bypass to CPGND with a 1F capacitor.
25
SCL
I
2C-Compatible Serial Clock Input. Connect a 10k
Ω pullup resistor to DVDD for full output
swing.
26
SDA
I
2C-Compatible Serial Data Input/Output. Connect a 10k
Ω pullup resistor to DVDD for full
output swing.
27
SDINS1
Primary Interface Digital Audio Serial Data DAC Input. Voiceband filtering available on this
input.
28
SDOUTS1
Primary Interface Digital Audio Serial Data ADC Output. Voiceband filtering available on
this output.
29
BCLKS1
Primary Interface Digital Audio Bit Clock Input/Output. BCLKS1 is an input when the
MAX9851/MAX9853 is in slave mode and an output when in master mode.
30
LRCLKS1
Primary Interface Digital Audio Left-Right Clock Input/Output. LRCLKS1 is the audio
sample rate clock and determines whether the audio data on SDINS1 is routed to the left
or right channel. LRCLKS1 is an input when the MAX9851/MAX9853 is in slave mode and
an output when in master mode.
31
DGND
Digital Ground
32
DVDD
Digital Power-Supply Input. DVDD provides power to the digital core, the I
2C interface and
the primary digital audio interface. Bypass to DGND with a 1F capacitor.
33
LRCLKS2
Secondary Interface Digital Audio Left-Right Clock Input/Output. LRCLKS2 is the audio
sample rate clock and determines whether the audio data on SDINS2 is routed to the left
or right channel. LRCLKS2 is an input when the MAX9851/MAX9853 is in slave mode and
an output when in master mode.
34
BCLKS2
Secondary Interface Digital Audio Bit Clock Input/Output. BCLKS2 is an input when the
MAX9851/MAX9853 is in slave mode and an output when in master mode.
35
SDOUTS2
Secondary Interface Digital Audio Serial Data ADC Output
36
SDINS2
Secondary Interface Digital Audio Serial Data DAC Input
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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