參數(shù)資料
型號(hào)： MB88155PFTG-111-BNDE1
廠商： FUJITSU LTD
元件分類： 時(shí)鐘產(chǎn)生/分配
英文描述： 50 MHz, OTHER CLOCK GENERATOR, PDSO8
封裝： TSSOP-8
文件頁(yè)數(shù)： 9/25頁(yè)
文件大?。?/td> 200K
代理商： MB88155PFTG-111-BNDE1
MB88155
17
■ LOCK-UP TIME
If the XPD pin is fixed at the “H” level, the maximum time after the power is turned on until the set clock signal is
output from CKOUT pin is (the stabilization wait time of input clock to XIN pin)
+ (the lock-up time “tLK”). For the
input clock stabilization time, check the characteristics of the resonator or oscillator used.
If the XPD pin is used for power-down control, the set clock signal is output from the CKOUT pin at most the lock-
up time “tLK” after the XPD pin goes “H” level.
(Continued)
3.0 V
VDD
XIN
XPD
VIH
CKOUT
SEL
ENS
External clock
stabilization waiting time
tLK
(Lock-up time)
VIH
3.0 V
VDD
XIN
XPD
CKOUT
SEL
ENS
External clock
stabilization waiting time
tLK
(Lock-up time)
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PDF描述
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