參數(shù)資料
型號(hào)： MB91107PFV
元件分類： 微控制器/微處理器
英文描述： 32-BIT, 50 MHz, RISC MICROCONTROLLER, PQFP120
封裝： PLASTIC, LQFP-120
文件頁(yè)數(shù)： 48/96頁(yè)
文件大?。?/td> 1342K
代理商： MB91107PFV
MB91107/108
52
(2) Block diagram
*1 : DLY I stands for delayed interrupt module (delayed interrupt generation block) (refer to the section “11. Delayed
Interrupt Module” for detail).
*2 : INT0 is a wake-up signal to clock control block in the sleep or stop status.
*3 : HLDCAN is a bus release request signal for bus masters other than CPU.
*4 : LEVEL 4 to LEVEL 0 are interrupt level outputs.
*5 : VCT5 to VCT0 are interrupt vector outputs.
INT02
OR
NMI
RI00
RI47
(DLYIRQ)
DLYI1
4
5
6
LEVEL
4
04
HLDCAN3
VCT5
05
R-BUS
IM
ICR00
ICR47
Priority judgment
NMI
processing
LEVEL judgment
VECTOR
judgment
LEVEL,
VECTOR
generation
HLDREQ
cancel
request
相關(guān)PDF資料
PDF描述
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