參數(shù)資料
型號： MB95F352LPFT-G-SNE2
廠商： FUJITSU LTD
元件分類： 微控制器/微處理器
英文描述： MICROCONTROLLER, PDSO24
封裝： 4.40 X 7.80 MM, 1.20 MM HEIGHT, 0.65 MM PITCH, PLASTIC, TSSOP-24
文件頁數(shù)： 37/60頁
文件大?。?/td> 3076K
代理商： MB95F352LPFT-G-SNE2
MB95350L Series
42
DS07–12631–2E
Sampling is executed at the rising edge of the sampling clock*1, and serial clock delay is enabled*2.
(ESCR register: SCES bit = 0, ECCR register: SCDE bit = 1)
(VCC = 3.0 V to 3.6 V, VSS = 0.0 V, TA =
40°C to +85°C)
*1: There is a function used to choose whether the sampling of reception data is performed at a rising edge or
a falling edge of the serial clock.
*2: The serial clock delay function is a function that delays the output signal of the serial clock for half clock.
Parameter
Symbol Pin name
Condition
Value
Unit
Min
Max
Serial clock cycle time
tSCYC
SCK
Internal clock
operation output pin:
CL = 80 pF
+ 1 TTL
5 tMCLK*3
—ns
SCK
↑ → SOT delay time
tSHOVI
SCK, SOT
95
+95
ns
Valid SIN
→ SCK ↓
tIVSLI
SCK, SIN
tMCLK*3
+ 190
—
ns
SCK
↓ → valid SIN hold time
tSLIXI
SCK, SIN
0
—
ns
SOT
→ SCK ↓ delay time
tSOVLI
SCK, SOT
—
4 tMCLK*3
ns
2.4 V
0.8 V
tSHOVI
tSOVLI
tIVSLI
tSLIXI
2.4 V
0.8 V
2.4 V
0.8 V
SCK
SOT
SIN
0.8 VCC
0.2 VCC
0.8 VCC
0.2 VCC
tSCYC
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PDF描述
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參數(shù)描述
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MB95F374LPMC1-G-SNE2 制造商:FUJITSU 功能描述:
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