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參數(shù)資料
| 型號： | MC100ES60T23EF |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 4/8頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC XLATOR LV PECL DUAL 8-SOIC |
| 標(biāo)準(zhǔn)包裝： | 97 |
| 系列： | 100ES |
| 邏輯功能： | 變換器 |
| 位數(shù)： | 2 |
| 輸入類型： | LVPECL |
| 輸出類型： | LVTTL |
| 通道數(shù)： | 2 |
| 輸出/通道數(shù)目： | 1 |
| 差分 - 輸入:輸出： | 是/無 |
| 傳輸延遲（最大）： | 1.75ns |
| 電源電壓： | 3 V ~ 3.6 V |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 8-SOIC（0.154"，3.90mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 8-SOIC |
| 包裝： | 管件 |
| 其它名稱： | 800-2225 MC100ES60T23EF-ND |
MC100ES60T23 REVISION 3 DECEMBER 14, 2012
4
2012 Integrated Device Technology, Inc.
MC100ES60T23 DATA SHEET
3.3V DUAL DIFFERENTIAL LVPECL TO LVTTL TRANSLATOR
ADDITIVE PHASE JITTER
The spectral purity in a band at a specific offset from the
fundamental compared to the power of the fundamental is
called the dBc Phase Noise. This value is normally expressed
using a Phase noise plot and is most often the specified plot
in many applications. Phase noise is defined as the ratio of
the noise power present in a 1Hz band at a specified offset
from the fundamental frequency to the power value of the
fundamental. This ratio is expressed in decibels (dBm) or a
ratio of the power in the 1Hz band to the power in the
fundamental. When the required offset is specified, the phase
noise is called a dBc value, which simply means dBm at a
specified offset from the fundamental. By investigating jitter in
the frequency domain, we get a better understanding of its
effects on the desired application over the entire time record
of the signal. It is mathematically possible to calculate an
expected bit error rate given a phase noise plot.
As with most timing specifications, phase noise
measurements have issues. The primary issue relates to the
limitations of the equipment. Often the noise floor of the
equipment is higher than the noise floor of the device. This is
illustrated above. The device meets the noise floor of what is
shown, but can actually be lower. The phase noise is
dependant on the input source and measurement equipment.
Offset From Carrier Frequency (Hz)
SSB
Ph
ase
No
is
edBc
/Hz
Additive Phase Jitter
@ 156.25MHz (12kHz-20MHz) = 0.18ps typical
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| VE-24K-MY-F1 | CONVERTER MOD DC/DC 40V 50W |
| LTC2604IGN-1#PBF | IC DAC 16BIT QUAD R-R 16-SSOP |
| LTC2604IGN#PBF | IC DAC 16BIT QUAD R-R OUT 16SSOP |
| GTC06CF-32-82P | CONN PLUG 16POS STRAIGHT W/PINS |
| M83723/85G1212N | CONN RCPT 12POS JAM NUT W/PINS |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MC100ES60T23EFR2 | 功能描述:時鐘發(fā)生器及支持產(chǎn)品 FSL Diff. LVPECL to LVTTL/LVCMOS Trans. RoHS:否 制造商:Silicon Labs 類型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數(shù)量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:QFN-56 |
| MC100ES6111AC | 功能描述:時鐘緩沖器 Buffer RoHS:否 制造商:Texas Instruments 輸出端數(shù)量:5 最大輸入頻率:40 MHz 傳播延遲（最大值）: 電源電壓-最大:3.45 V 電源電壓-最小:2.375 V 最大功率耗散: 最大工作溫度:+ 85 C 最小工作溫度:- 40 C 封裝 / 箱體:LLP-24 封裝:Reel |
| MC100ES6111ACR2 | 功能描述:時鐘緩沖器 FSL 1-10 Diff LVPECL Fanout Buffer RoHS:否 制造商:Texas Instruments 輸出端數(shù)量:5 最大輸入頻率:40 MHz 傳播延遲（最大值）: 電源電壓-最大:3.45 V 電源電壓-最小:2.375 V 最大功率耗散: 最大工作溫度:+ 85 C 最小工作溫度:- 40 C 封裝 / 箱體:LLP-24 封裝:Reel |
| MC100ES6111FA | 功能描述:時鐘緩沖器 Buffer RoHS:否 制造商:Texas Instruments 輸出端數(shù)量:5 最大輸入頻率:40 MHz 傳播延遲（最大值）: 電源電壓-最大:3.45 V 電源電壓-最小:2.375 V 最大功率耗散: 最大工作溫度:+ 85 C 最小工作溫度:- 40 C 封裝 / 箱體:LLP-24 封裝:Reel |
| MC100ES6111FAR2 | 功能描述:IC CLOCK BUFFER MUX 2:10 32-LQFP RoHS:否 類別:集成電路 (IC) >> 時鐘/計時 - 時鐘緩沖器，驅(qū)動器 系列:100ES 標(biāo)準(zhǔn)包裝:1 系列:HiPerClockS™ 類型:扇出緩沖器（分配），多路復(fù)用器 電路數(shù):1 比率 - 輸入:輸出:2:18 差分 - 輸入:輸出:是/無 輸入:CML，LVCMOS，LVPECL，LVTTL，SSTL 輸出:LVCMOS，LVTTL 頻率 - 最大:250MHz 電源電壓:2.375 V ~ 3.465 V 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:32-LQFP 供應(yīng)商設(shè)備封裝:32-TQFP（7x7） 包裝:- 其它名稱:800-1923-6 |
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