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參數(shù)資料
| 型號： | MC33389DDW |
| 廠商： | MOTOROLA INC |
| 元件分類： | 網(wǎng)絡(luò)接口 |
| 英文描述： | System Basis Chip with Low Speed Fault Tolerant CAN |
| 中文描述： | DATACOM, INTERFACE CIRCUIT, PDSO28 |
| 封裝： | PLASTIC, SO-28 |
| 文件頁數(shù)： | 7/35頁 |
| 文件大?。?/td> | 609K |
| 代理商： | MC33389DDW |
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MC33389
MOTOROLA
7
MC33389
TX Permanent Dominant
Timer Disable Time
T
txd
0.75
4
ms
BusNormal Mode and
Failure Mode
TX, MOSI, SCK, CSB
High Level Input Voltage
0.7V1
V1+0.3V
CSB Threshold for SPI Wake-up
2.2
V
SBC in Sleep Mode,
V1<1.5V
CSB Filter Time for SPI Wake-up
3
μ
s
SBC in Sleep Mode, V1<1V
Low Level Input Voltage
-0.3
0.3 V1
V
High Level Input Current on CSB
-100
-20
μ
A
V
i
=4V
Low Level Input Current (CSB)
-100
-20
μ
A
V
i
=1V
TX High Level Input Current
I
TX
-200
-80
-25
μ
A
V
i
=4V
TX Low Level Input Current
I
TX
-800
-320
-100
μ
A
V
i
=1V
SI, SCK Input Current
-10
10
μ
A
0<V
IN
<V1
RX, INTB, MISO
High Level Output Voltage
Voh
V1-0.9
V1
V
I
0
=-250
μ
A
Low Level Output Voltage
Vol
0
0.9
V
I
0
=1.5mA
Tristated SO Output Current
Iz
-2
+2
μ
A
0V<V
so
<V1
RSTB Pin
High Level Input Voltage
Vih
0.7V1
V1+0.3V
Low Level Input Voltage
Vil
-0.3
0.3V1
V
High Level Output current 1
-50
-30
-10
μ
A
0<V
out
<0.5V1
High Level Output current 2
-300
μ
A
0.5<V
out
<V1
Low Level Output Voltage (I
0
=1.5mA)
0
0.9
V
1v<V
bat
<27V
Reset Duration after V1High
t
res
1
ms
L0, L1, L2 WAKE-UP INPUTS
Positive Switching Threshold
V
wup
3
3.7
4.5
V
6V<V
bat
<16V
Negative Switching Threshold
V
wun
2.5
3
3.8
V
6V<V
bat
<16V
Hysteresis
V
hyst
700
mV
6V<V
bat
<16V
Leakage Current 0<Vwu<V
bat
-5
+5
μ
A
Wake up Filter Time
8
20
38
μ
s
Lx input current @ 40V
Vin
350
600
μ
A
DIGITAL INTERFACE TIMING
SCLK Clock Period
t
pSCLK
500
ns
Parameter
Symbol
Min
Typ
Max
Unit
Test Conditions
F
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
.
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PDF描述 |
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