參數(shù)資料
型號： MC33389DDWR2
廠商： Freescale Semiconductor
文件頁數(shù)： 5/49頁
文件大?。?/td> 0K
描述： IC SYSTEM BASE W/CAN 28-SOIC
標準包裝： 1
控制器類型： 系統(tǒng)基礎(chǔ)芯片
接口： CAN
電源電壓： 5.5 V ~ 18 V
電流 - 電源： 45mA
工作溫度： -40°C ~ 125°C
安裝類型： 表面貼裝
封裝/外殼： 28-SOIC（0.295"，7.50mm 寬）
供應商設(shè)備封裝： 28-SOIC W
包裝： 剪切帶 (CT)
其它名稱： MC33389DDWR2CT
Analog Integrated Circuit Device Data
Freescale Semiconductor
13
33389
ELECTRICAL CHARACTERISTICS
DYNAMIC ELECTRICAL CHARACTERISTICS
DYNAMIC ELECTRICAL CHARACTERISTICS
Table 5. Dynamic Electrical Characteristics
Characteristics noted under conditions 7.0 V
≤ V
SUP ≤ 18 V, - 40°C ≤ T
A ≤ 125°C, GND = 0 V unless otherwise noted. Typical
values noted reflect the approximate parameter means at TA = 25°C under nominal conditions unless otherwise noted.
Characteristic
Symbol
Min
Typ
Max
Unit
MICROCONTROLLER INTERFACE
AC CANL/CANH Slew Rates, Rising or Falling Edges, TX from Recessive to
Dominant State
CLOAD - 10 nF, 133 Termination Resistors
tCANRD
3.5
5.0
10
V/s
AC CANL/CANH Slew Rates, Rising or Falling Edges, TX from Dominant to
Recessive State
CLOAD - 10 nF, 133 Termination Resistors
tCANDR
2.0
3.5
10
V/s
AC Propagation Delay TX to RX Low
CLOAD - 10 nF, 133 Termination Resistors
tDH
—
1.2
2.0
s
AC Propagation Delay TX to RX High
CLOAD - 10 nF, 133 Termination Resistors
tDL
—
2.0
3.0
s
Wake-Up Filter Time
tWUFT
8.0
20
38
s
RST Duration after V1 High
tRES
—
1.0
—
ms
SCLK Clock Period
tPSCLK
500
—
ns
SCLK Clock High Time
tWSCLKH
175
—
ns
SCLK Clock Low Time
tWSCLKL
175
—
ns
Falling Edge of CS to Rising Edge of SCLK
tLEAD
250
50
—
ns
Falling Edge of SCLK to Rising Edge of CS
tLEAD
250
50
—
ns
SI to Falling Edge of SCLK
tSISU
125
25
—
ns
Falling Edge of SCLK to SI
tSI(HOLD)
125
25
—
ns
SO Rise Time (CL = 200 pF)
tRSO
—
25
75
ns
SO Fall Time (CL = 200 pF)
tFSO
—
25
75
ns
SI, CS, SCLK Incoming Signal Rise Time
tRSI
—
200
ns
SI, CS, SCLK Incoming Signal Fall Time
tFSI
—
200
—
Time from Falling Edge of CS to SO
Low Impedance
High Impedance
tSO(EN)
tSO(DIS)
—
200
ns
Time from Rising Edge of SCLK to SO Data Valid
0.2 V1 or V2 < SO > 0.8 V1 or V2, CL = 200 pF
tVALID
—
50
125
—
Running Mode Oscillator Tolerance (Normal Request, Normal and Stand-by
Modes (9))
RMOT
-12
—
+12
%
Software Watchdog Timing 1 (9)
tSW1
4.4
5.0
5.6
ms
Software Watchdog Timing 2 (9)
tSW2
8.8
10
11.2
ms
Software Watchdog Timing 3 (9)
tSW3
17.6
20
22.4
ms
Software Watchdog Timing 4 (9)
tSW4
28
32
36
ms
Notes
9.
Software watchdog timing accuracy is based on the running mode oscillator tolerance
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PDF描述
MC33389CDWR2 IC SYSTEM BASE W/CAN 28-SOIC
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MC33889DW IC SYSTEM BASE W/CAN 28-SOIC
MC33389CDW IC SYSTEM BASE W/CAN 28-SOIC
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參數(shù)描述
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