LOGIC COMMANDS AND REGISTERS j Figure 22. W" />
參數(shù)資料
型號： MC33889DPEGR2
廠商： Freescale Semiconductor
文件頁數(shù)： 43/59頁
文件大?。?/td> 0K
描述： IC SYSTEM BASE W/CAN 28SOIC
標(biāo)準(zhǔn)包裝： 1,000
系列： *
Analog Integrated Circuit Device Data
48
Freescale Semiconductor
33889
FUNCTIONAL DEVICE OPERATION
LOGIC COMMANDS AND REGISTERS
j
Figure 22. Watchdog Operation (window and timeout)
TIM2 register
The purpose of TIM2 register is to select an appropriate timing for sensing the wake-up circuitry or cyclically supplying devices
by switching on or off HS1
Table 25. TIM2 Register
TIM2
D3
D2
D1
D0
$101b
W
1
CSP2
CSP1
CSP0
R
Reset
0
Reset condition
POR, RESET
Table 26. Cyclic Sense Timing
CSP2
CSP1
CSP0
Cyclic Sense Timing [ms]
0
5
0
1
10
0
1
0
20
0
1
40
1
0
75
1
0
1
100
1
0
200
1
400
window closed
window open
WD timing * 50%
Watchdog period
for watchdog clear
no watchdog clear
window open
Watchdog period
for watchdog clear
(WD timing selected by TIM 1 bit WDW=1)
(WD timing selected by TIM 1, bit WDW=0)
Timeout watchdog
Window watchdog
相關(guān)PDF資料
PDF描述
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參數(shù)描述
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