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參數(shù)資料
| 型號： | MC68302CRC20 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | Integrated Multiprotocol Processor User’s Manual |
| 中文描述： | RISC PROCESSOR, CPGA132 |
| 封裝： | PGA-132 |
| 文件頁數(shù)： | 18/480頁 |
| 文件大?。?/td> | 1815K |
| 代理商： | MC68302CRC20 |
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Table of Contents
Figure
Number
Figure 4-5.
Figure 4-6.
Figure 4-7.
Figure 4-8.
Figure 4-9.
Figure 4-10. PCM Channel Assignment on a T1/CEPT Line .......................................4-19
Figure 4-11. SCC Block Diagram.................................................................................4-24
Figure 4-12. SCC Baud Rate Generator ......................................................................4-26
Figure 4-13. Output Delays from RTS Low, Synchronous Protocol.............................4-29
Figure 4-14. Output Delays from CTS Low, Synchronous Protocol.............................4-29
Figure 4-15. Memory Structure.....................................................................................4-32
Figure 4-16. SCC Buffer Descriptor Format.................................................................4-33
Figure 4-17. UART Frame Format................................................................................4-43
Figure 4-18. Two Configurations of UART Multidrop Operation...................................4-50
Figure 4-19. UART Control Characters Table..............................................................4-51
Figure 4-20. UART Receive Buffer Descriptor .............................................................4-58
Figure 4-21. UART Rx BD Example.............................................................................4-59
Figure 4-22. UART Transmit Buffer Descriptor ............................................................4-61
Figure 4-23. UART Interrupt Events Example..............................................................4-64
Figure 4-24. Typical HDLC Frame................................................................................4-66
Figure 4-25. HDLC Address Recognition Examples ....................................................4-71
Figure 4-26. HDLC Receive Buffer Descriptor .............................................................4-75
Figure 4-27. HDLC Receive BD Example ....................................................................4-76
Figure 4-28. HDLC Transmit Buffer Descriptor ............................................................4-78
Figure 4-29. HDLC Interrupt Events Example..............................................................4-81
Figure 4-30. Typical BISYNC Frames..........................................................................4-83
Figure 4-31. BISYNC Control Characters Table...........................................................4-88
Figure 4-32. BISYNC Receive Buffer Descriptor..........................................................4-93
Figure 4-33. BISYNC Transmit Buffer Descriptor.........................................................4-95
Figure 4-34. Typical DDCMP Frames ........................................................................4-100
Figure 4-35. DDCMP Transmission/Reception Summary..........................................4-102
Figure 4-36. DDCMP Receive Buffer Descriptor........................................................4-109
Figure 4-37. DDCMP Transmit Buffer Descriptor.......................................................4-112
Figure 4-38. Two-Step Synchronous Bit Rate Adaption.............................................4-116
Figure 4-39. Three-Step Asynchronous Bit Rate Adaption ........................................4-117
Figure 4-40. V.110 Receive Buffer Descriptor............................................................4-119
Figure 4-41. V.110 Transmit Buffer Descriptor...........................................................4-120
Figure 4-42. Transparent Receive Buffer Descriptor..................................................4-130
Figure 4-43. Transparent Transmit Buffer Descriptor.................................................4-131
Figure 4-44. SCP Timing............................................................................................4-135
Figure 4-45. SCP vs. SCC Pin Multiplexing ...............................................................4-137
Title
Page
Number
xviii
MC68302 USER’S MANUAL
MOTOROLA
Serial Channels Physical Interface Block Diagram..................................4-10
IDL Bus Signals .......................................................................................4-11
IDL Terminal Adaptor...............................................................................4-12
GCI Bus Signals.......................................................................................4-15
Two PCM Sync Methods..........................................................................4-18
Section 5
Signal Description
Figure 5-1.
Functional Signal Groups...........................................................................5-3
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PDF描述 |
|---|---|
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參數(shù)描述 |
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| MC68302EH16C | 功能描述:微處理器 - MPU 68K INTGR COM PROC DMA RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324 |
| MC68302EH16C | 制造商:Freescale Semiconductor 功能描述:32-Bit Microcontroller IC |
| MC68302EH16CB1 | 功能描述:微處理器 - MPU 68K INTGR COM PROC DMA RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324 |
| MC68302EH16CR2 | 功能描述:微處理器 - MPU 68K INTGR COM PROC DMA RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時鐘頻率:536 MHz 程序存儲器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324 |
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