參數(shù)資料
型號(hào)： MC68336AMFT20
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 32-BIT, MROM, 20.97 MHz, MICROCONTROLLER, PQFP160
封裝： PLASTIC, QFP-160
文件頁數(shù)： 273/440頁
文件大?。?/td> 5622K
代理商： MC68336AMFT20
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MC68336/376
REGISTER SUMMARY
MOTOROLA
USER’S MANUAL
Rev. 15 Oct 2000
D-22
This bit controls whether SRAM operates normally or enters low-power stop mode. In
low-power stop mode, the array retains its contents, but cannot be read or written.
RLCK — RAM Base Address Lock
0 = SRAM base address registers can be written.
1 = SRAM base address registers are locked.
RLCK defaults to zero on reset; it can be written once to one
RASP[1:0] — RAM Array Space
The RASP field limits access to the SRAM array to one of four CPU32 address spaces.
Refer to Table D-20.
D.3.2 RAM Test Register
RAMTST — RAM Test Register
$YFFB42
Used for factory test only.
D.3.3 Array Base Address Register High
D.3.4 Array Base Address Register Low
RAMBAH and RAMBAL specify the SRAM array base address in the system memory
map. They can only be written while the SRAM is in low-power stop mode (STOP = 1,
the default out of reset) and the base address lock is disabled (RLCK = 0, the default
out of reset). This prevents accidental remapping of the array.
Table D-20 RASP Encoding
RASP[1:0]
Space
00
Unrestricted program and data
01
Unrestricted program
10
Supervisor program and data
11
Supervisor program
RAMBAH — Array Base Address Register High
$YFFB44
15
8
7
6
5
4
3
2
1
0
NOT USED
ADDR
23
ADDR
22
ADDR
21
ADDR
20
ADDR
19
ADDR
18
ADDR
17
ADDR
16
RESET:
0
RAMBAL — Array Base Address Register Low
$YFFB46
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
ADDR
15
ADDR
14
ADDR
13
ADDR
12
0
RESET:
0
相關(guān)PDF資料
PDF描述
MC68376BGMFT20 32-BIT, MROM, 20.97 MHz, MICROCONTROLLER, PQFP160
MC68376BACFT20B1 32-BIT, MROM, 20.97 MHz, MICROCONTROLLER, PQFP160
MC68376BGVFT20B1 32-BIT, MROM, 20.97 MHz, MICROCONTROLLER, PQFP160
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參數(shù)描述
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MC68336GMFT20 制造商:Motorola Inc 功能描述: 制造商:MOTOROLA 功能描述:
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