MC68EC040 REV2.3 (01/31/2000) ADDRESS MASK eld equals $0F, the W-bit " />
參數(shù)資料
型號(hào)： MC68EC040FE40A
廠商： Freescale Semiconductor
文件頁(yè)數(shù)： 316/442頁(yè)
文件大?。?/td> 0K
描述： IC MPU 32BIT 40MHZ 184-CQFP
標(biāo)準(zhǔn)包裝： 24
系列： M680x0
處理器類型： M680x0 32-位
速度： 40MHz
電壓： 5V
安裝類型： 表面貼裝
封裝/外殼： 184-BCQFP
供應(yīng)商設(shè)備封裝： 184-CQFP（31.3x31.3）
包裝： 托盤
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MOTOROLA
M68040 USER’S MANUAL
B-7
MC68EC040 REV2.3 (01/31/2000)
ADDRESS MASK eld equals $0F, the W-bit is set to one, and the S-eld = $1. The inclusion
of independent ACRs in both the instruction ACU (IACU) and data ACU (DACU provides an
exception to the merged instruction and data address space, allowing different access con-
trol for instruction and operand accesses. Also, since the instruction memory unit is only
used for instruction prefetches, different instruction and data ACRs can cause PC relative
operand fetches to be translated differently from instruction prefetches.
Matching either of the ACRs in a corresponding ACU during an access to a memory unit
completes the access with the ACU. If both registers match, the access uses the xACR0 sta-
tus bits. Addresses are passed through without translation if there is no match in the ACRs
and no table search occurs. The MC68EC040 does not perform table searches.
B.3.3 Effect of RSTI on the ACU
When the assertion of the reset input (RSTI) signal resets the MC68EC040, the E-bits of the
ACRs are cleared, disabling address access control.
B.4 SPECIAL MODES OF OPERATION
This part of the M68040 User's Manual does not apply to the MC68EC040. The
MC68EC040 does not sample the IPL2–IPL0, CDIS, JS0 (DLE on the MC68040), or JS1
(MDIS on the MC68040) pins on the rising edge of RSTI.
An external device asserts RSTI to reset the processor. When power is applied to the sys-
tem, external circuitry should assert RSTI for a minimum of 10 BCLK cycles after VCC is
within tolerance. Figure B-5 is a functional timing diagram of the power-on reset operation,
illustrating the relationships between VCC, RSTI, and bus signals. The BCLK and PCLK
clock signals are required to be stable by the time VCC reaches the minimum operating spec-
ication. RSTI is internally synchronized for two BCLKS before being used, and must meet
the specied setup and hold times to BCLK (specications #51 and #52 in MC68EC040
Electrical Characteristics) only if recognition by a specic BCLK rising edge is required.
Once RSTI is negated, the processor is internally held in reset for another 128 clock cycles.
During the reset period, all three-statable signals are three-stated, and the rest are driven to
their inactive state. Once the internal reset signal negates, all bus signals remain in a
high-impedance state until the processor is granted the bus. After this, the rst bus cycle for
reset exception processing begins. In Figure B-6, the processor assumes implicit ownership
of the bus before the rst bus cycle begins. The levels on the CDIS, JS1 (MDIS on the
MC68040), and IPL2–IPL0 signals are not sampled when RSTI is negated.
For processor resets after the initial power-on reset, should be asserted for at least 10 clock
periods. Figure B-6 illustrates timing associated with a reset when the processor is executing
bus cycles. Note that BB and TIP (and TA driven during a snooped access) are asserted
before transitioning to a three-state level. Processor reset causes any bus cycle in progress
to terminate as if TA or TEA had been asserted. Also, the processor initializes registers
appropriately for a reset exception.
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Freescale Semiconductor, Inc.
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相關(guān)PDF資料
PDF描述
MPC8545EVTANGB MPU POWERQUICC III 783-PBGA
MPC8545EPXANGB MPU POWERQUICC III 783-PBGA
IDT71T75602S166BGGI8 IC SRAM 18MBIT 166MHZ 119BGA
MPC8264AVVPIBB IC MPU POWERQUICC II 480-TBGA
IDT70V525ML55BZI8 IC SRAM 128KBIT 55NS 144FBGA
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
MC68EC040RC20A 功能描述:微處理器 - MPU 32B W/ CACHE RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時(shí)鐘頻率:536 MHz 程序存儲(chǔ)器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324
MC68EC040RC20B 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:M68000-compatible, high-performance, 32-bit microprocessors
MC68EC040RC25A 功能描述:微處理器 - MPU 32B W/ CACHE RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時(shí)鐘頻率:536 MHz 程序存儲(chǔ)器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324
MC68EC040RC25B 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:M68000-compatible, high-performance, 32-bit microprocessors
MC68EC040RC33A 功能描述:微處理器 - MPU 32B W/ CACHE RoHS:否 制造商:Atmel 處理器系列:SAMA5D31 核心:ARM Cortex A5 數(shù)據(jù)總線寬度:32 bit 最大時(shí)鐘頻率:536 MHz 程序存儲(chǔ)器大小:32 KB 數(shù)據(jù) RAM 大小:128 KB 接口類型:CAN, Ethernet, LIN, SPI,TWI, UART, USB 工作電源電壓:1.8 V to 3.3 V 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:FBGA-324
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