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參數(shù)資料
| 型號(hào)： | MC68HC05B16FNR2 |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PQCC52 |
| 封裝： | PLASTIC, LCC-52 |
| 文件頁數(shù)： | 18/298頁 |
| 文件大?。?/td> | 3532K |
| 代理商： | MC68HC05B16FNR2 |
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MOTOROLA
9-10
MC68HC05B6
Rev. 4
RESETS AND INTERRUPTS
9
interrupt which is not latched); therefore, only one external interrupt pulse can be
latched during tILIL and serviced as soon as the I-bit is cleared.
9.2.3.3
Timer interrupts
There are ve different timer interrupt ags (ICF1, ICF2, OCF1, OCF2 and TOF) that will cause a
timer interrupt whenever they are set and enabled. These ve interrupt ags are found in the ve
most signicant bits of the timer status register (TSR) at location $0013. ICF1 and ICF2 will vector
to the service routine dened by $1FF8-$1FF9, OCF1 and OCF2 will vector to the service routine
dened by $1FF6–$1FF7 and TOF will vector to the service routine dened by $1FF4–$1FF5 as
shown in Figure 5.1.
There are three corresponding enable bits; ICIE for ICF1 and ICF2, OCIE for OCF1 and OCF2,
and TOIE for TOF. These enable bits are located in the timer control register (TCR) at address
$0012. See Section 5.2.1 and Section 5.2.2 for further information.
9.2.3.4
Serial communications interface (SCI) interrupts
There are ve different interrupt ags (TDRE, TC, OR, RDRF and IDLE) that cause SCI interrupts
whenever they are set and enabled. These ve interrupt ags are found in the ve most signicant
bits of the SCI status register (SCSR) at location $0010.
There are four corresponding enable bits: TIE for TDRE, TCIE for TC, RIE for OR and RDRF, and
ILIE for IDLE. These enable bits are located in the serial communications control register 2
(SCCR2) at address $000F. See Section 6.11.3 and Section 6.11.4.
The SCI interrupt causes the program counter to vector to the address pointed to by memory
locations $1FF2 and $1FF3 which contain the starting address of the interrupt service routine.
Software in the SCI interrupt service routine must determine the priority and cause of the interrupt
by examining the interrupt ags and the status bits located in the serial communications status
register SCSR (address $0010).
The general sequence for clearing an interrupt is a software sequence of accessing the serial
communications status register while the ag is set followed by a read or write of an associated
register. Refer to Section 6 for a description of the SCI system and its interrupts.
TPG
112
05B6Book Page 10 Tuesday, April 6, 1999 8:24 am
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MC68HC05B16CFNR2 | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PQCC52 |
| MC68HC05B4FNR2 | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PQCC52 |
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| MC68HC705B16FNR2 | 8-BIT, OTPROM, 2.1 MHz, MICROCONTROLLER, PQCC52 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| MC68HC05B5 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
| MC68HC05B6 | 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers |
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