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參數(shù)資料
| 型號(hào)： | MC68HC05B8MFN |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PQCC52 |
| 封裝： | PLASTIC, LCC-52 |
| 文件頁(yè)數(shù)： | 183/302頁(yè) |
| 文件大?。?/td> | 3940K |
| 代理商： | MC68HC05B8MFN |
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MC68HC05B6
Rev. 4.1
Freescale
H-13
MC68HC705B32
14
Pr
eli
min
ary
Pr
eli
mi
na
ry
Pr
eli
min
ary
H.5
Bootstrap mode
Oscillator divide-by-two is forced in bootstrap mode.
The 432 bytes of self-check firmware on the MC68HC05B6 are replaced by 654 bytes of bootstrap
firmware. A detailed description of the modes of operation within bootstrap mode is given below.
The bootstrap program in mask ROM address locations $0200 to $024F, $03B0 to $3FFF, $7E00
to $7FDD and $7FE0 to $7FEF can be used to program the EPROM and the EEPROM, to check
if the EPROM is erased or to load and execute data in RAM.
After reset, while going to the bootstrap mode, the vector located at address $7FEE and $7FEF
(RESET) is fetched to start execution of the bootstrap program. To place the part in bootstrap
mode, the IRQ pin should be at 2xVDD with the TCAP1 pin ‘high’ during transition of the RESET
pin from low to high. The hold time on the IRQ and TCAP1 pins is two clock cycles after the
external RESET pin is brought high.
When the MC68HC705B32 is placed in the bootstrap mode, the bootstrap reset vector will be
fetched and the bootstrap firmware will start to execute. Table H-4 shows the conditions required
to enter each level of bootstrap mode on the rising edge of RESET.
The bootstrap program will first copy part of itself in RAM (except ‘RAM parallel load’), as the
program cannot be executed in ROM during verification/programming of the EPROM. It will then
set the TCMP1 output to a logic high level, unlike the MC68HC05B6 which keeps TCMP1 low. This
can be used to distinguish between the two circuits and, in particular, for selection of the VPP level
and current capability.
Table H-4 Mode of operation selection
IRQ pin
TCAP1 pin PD1 PD2 PD3 PD4
Mode
VSS to VDD VSS to VDD
xxxx
Single chip
2xVDD
VDD
0
x
Erased EPROM verification
2xVDD
VDD
1000
EPROM verification; erase EEPROM;
EPROM/EEPROM parallel program/verify
2xVDD
VDD
0100
Erased EPROM verification;
no EEPROM erase if SEC is zero (parallel mode)
2xVDD
VDD
1100
Erased EPROM verification; erase EEPROM;
EPROM parallel program/verify (no E2)
2xVDD
VDD
x
1
0
Jump to start of RAM ($0051); SEC bit = ACTIVE
2xVDD
VDD
0101
EPROM and EEPROM verification; SEC bit = ACTIVE (parallel mode)
2xVDD
VDD
xx
1
Serial RAM load/execute – similar to MC68HC05B6 but can fill RAM I,
II and III
x = Don’t care
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