參數(shù)資料
型號: MC68HC05JJ6CDWE
廠商: FREESCALE SEMICONDUCTOR INC
元件分類: 微控制器/微處理器
英文描述: 8-BIT, MROM, 2.1 MHz, MICROCONTROLLER, PDSO20
封裝: ROHS COMPLIANT, SOIC-20
文件頁數(shù): 191/216頁
文件大小: 1763K
代理商: MC68HC05JJ6CDWE
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NON-DISCLOSURE
AGREEMENT
REQUIRED
Operating Modes
General Release Specification
MC68HC05JJ6/MC68HC05JP6 Rev. 3.2
76
Operating Modes
Freescale Semiconductor
6.4.3 Halt Mode
The STOP instruction puts the MCU in halt mode if selected by the stop
mask option. Halt mode is identical to wait mode, except that a variable
recovery delay occurs when the MCU exits halt mode. A recovery time
of from 1 to 16 or from 1 to 4064 internal bus cycles can be selected by
the oscillator startup delay mask option.
If the STOP instruction has been selected by the stop mask option to put
the MCU in halt mode, then the COP watchdog cannot be turned off
inadvertently by a STOP instruction.
6.4.4 Data-Retention Mode
In the data-retention mode, the MCU retains RAM contents and CPU
register contents at VDD voltages as low as 2.0 Vdc. The data retention
feature allows the MCU to remain in a low-power consumption state
during which it retains data, but the CPU cannot execute instructions.
To put the MCU in the data retention mode:
1. Drive the RESET pin to a logic zero.
2. Lower the VDD voltage. The RESET pin must remain low
continuously during data retention mode.
To take the MCU out of the data retention mode:
1. Return VDD to normal operating voltage.
2. Return the RESET pin to a logic one.
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PDF描述
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