參數(shù)資料
型號: MC68HC08GP16ACBE
廠商: FREESCALE SEMICONDUCTOR INC
元件分類: 微控制器/微處理器
英文描述: 8-BIT, MROM, 8.2 MHz, MICROCONTROLLER, PDIP42
封裝: LEAD FREE, PLASTIC, SDIP-42
文件頁數(shù): 142/258頁
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代理商: MC68HC08GP16ACBE
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Development Support
MC68HC08GP32A MC68HC08GP16A Data Sheet, Rev. 1.0
226
Freescale Semiconductor
19.3.1.3 Data Format
Communication with the monitor ROM is in standard non-return-to-zero (NRZ) mark/space data format.
Transmit and receive baud rates must be identical.
Figure 19-10. Monitor Data Format
19.3.1.4 Break Signal
A start bit (0) followed by nine 0 bits is a break signal. When the monitor receives a break signal, it drives
the PTA0 pin high for the duration of two bits and then echoes back the break signal.
Figure 19-11. Break Transaction
Table 19-1. Mode Differences
Modes
Functions
COP
Reset
Vector High
Reset
Vector Low
Break
Vector High
Break
Vector Low
SWI
Vector High
SWI
Vector Low
User
Enabled
$FFFE
$FFFF
$FFFC
$FFFD
$FFFC
$FFFD
Monitor
Disabled(1)
1. If the high voltage (VTST) is removed from the IRQ pin while in monitor mode, the SIM asserts its COP enable output. The
COP is a mask option enabled or disabled by the COPD bit in the mask option register. (See 20.5 5.0-V DC Electrical Char-
$FEFE
$FEFF
$FEFC
$FEFD
$FEFC
$FEFD
BIT 5
START
BIT
BIT 1
NEXT
STOP
BIT
START
BIT
BIT 2
BIT 3
BIT 4
BIT 7
BIT 0
BIT 6
0
1
2
3
4
5
6
7
0
1
2
3
4
5
6
7
MISSING STOP BIT
2-STOP BIT DELAY BEFORE ZERO ECHO
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