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參數(shù)資料
| 型號： | MC68HC08GZ32VFJ |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 8 MHz, MICROCONTROLLER, PQFP32 |
| 封裝： | 7 X 7 MM, 1.40 MM HEIGHT, 0.80 MM PITCH, PLASTIC, MS-026BBA, LQFP-32 |
| 文件頁數(shù)： | 194/320頁 |
| 文件大小： | 4400K |
| 代理商： | MC68HC08GZ32VFJ |
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I/O Registers
MC68HC08GZ32 Data Sheet, Rev. 3
Freescale Semiconductor
273
ELSxB and ELSxA — Edge/Level Select Bits
When channel x is an input capture channel, these read/write bits control the active edge-sensing logic
on channel x.
When channel x is an output compare channel, ELSxB and ELSxA control the channel x output
behavior when an output compare occurs.
When ELSxB and ELSxA are both clear, channel x is not connected to port D or port F, and pin
PTDx/T2CHx or pin PTFx/T2CHx is available as a general-purpose I/O pin. Table 19-2 shows how
ELSxB and ELSxA work. Reset clears the ELSxB and ELSxA bits.
NOTE
After initially enabling a TIM2 channel register for input capture operation
and selecting the edge sensitivity, clear CHxF to ignore any erroneous
edge detection flags.
TOVx — Toggle-On-Overflow Bit
When channel x is an output compare channel, this read/write bit controls the behavior of the channel
x output when the TIM2 counter overflows. When channel x is an input capture channel, TOVx has no
effect. Reset clears the TOVx bit.
1 = Channel x pin toggles on TIM2 counter overflow.
0 = Channel x pin does not toggle on TIM2 counter overflow.
NOTE
When TOVx is set, a TIM2 counter overflow takes precedence over a
channel x output compare if both occur at the same time.
CHxMAX — Channel x Maximum Duty Cycle Bit
When the TOVx bit is at 1 and clear output on compare is selected, setting the CHxMAX bit forces the
duty cycle of buffered and unbuffered PWM signals to 100%. As Figure 19-9 shows, the CHxMAX bit
takes effect in the cycle after it is set or cleared. The output stays at 100% duty cycle level until the
cycle after CHxMAX is cleared.
NOTE
The 100% PWM duty cycle is defined as a continuous high level if the PWM
polarity is 1 and a continuous low level if the PWM polarity is 0. Conversely,
a 0% PWM duty cycle is defined as a continuous low level if the PWM
polarity is 1 and a continuous high level if the PWM polarity is 0.
Table 19-2. Mode, Edge, and Level Selection
MSxB
MSxA
ELSxB
ELSxA
Mode
Configuration
X0
0
Output preset
Pin under port control; initial output level high
X
1
0
Pin under port control; initial output level low
00
0
1
Input capture
Capture on rising edge only
0
1
0
Capture on falling edge only
0
1
Capture on rising or falling edge
01
0
Output compare
or PWM
Software compare only
0
1
0
1
Toggle output on compare
0
1
0
Clear output on compare
0
1
Set output on compare
1X
0
1
Buffered output compare
or buffered PWM
Toggle output on compare
1
X
1
0
Clear output on compare
1
X
1
Set output on compare
相關PDF資料 |
PDF描述 |
|---|---|
| MC68HC08GZ32VFJE | 8-BIT, MROM, 8 MHz, MICROCONTROLLER, PQFP32 |
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相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
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