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參數(shù)資料
| 型號： | MC68HC08RC16DW |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, MICROCONTROLLER, PDSO28 |
| 封裝： | SOIC-28 |
| 文件頁數(shù)： | 9/200頁 |
| 文件大小： | 1856K |
| 代理商： | MC68HC08RC16DW |
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Technical Data
MC68HC08RC16 — Rev. 1.0
106
Input/Output Ports (I/O)
MOTOROLA
Input/Output Ports (I/O)
DDRA7–DDRA0 — Data Direction Register A Bits
These read/write bits control port A data direction. Reset clears
DDRA7–DDRA0, configuring all port A pins as inputs.
1 = Corresponding port A pin configured as output
0 = Corresponding port A pin configured as input
NOTE:
Avoid glitches on port A pins by writing to the port A data register before
changing data direction register A bits from 0 to 1.
Figure 11-4 shows the port A I/O logic.
Figure 11-4. Port A I/O Circuit
When bit DDRAx is a logic 1, reading address $0000 reads the PTAx
data latch. When bit DDRAx is a logic 0, reading address $0000 reads
the voltage level on the pin. The data latch can always be written,
regardless of the state of its data direction bit. Table 11-1 summarizes
the operation of the port A pins.
Table 11-1. Port A Pin Functions
DDRA
Bit
PTA
Bit
I/O Pin
Mode
Accesses
to DDRA
Accesses
to PTA
Read/Write
Read
Write
0
X(1)
1. X = Don’t care
Input, Hi-Z(2)
2. Hi-Z = High impedance
DDRA7–DDRA0
Pin
PTA7–PTA0(3)
3. Writing affects data register, but does not affect input.
1
X
Output
DDRA7–DDRA0
PTA7–PTA0
READ DDRA ($0004)
WRITE DDRA ($0004)
RESET
WRITE PTA ($0000)
READ PTA ($0000)
PTAx
DDRAx
PTAx
INTERNAL
D
AT
A
B
U
S
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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