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參數資料
| 型號： | MC68HC11K1CFUE4 |
| 廠商： | Freescale Semiconductor |
| 文件頁數： | 82/290頁 |
| 文件大?。?/td> | 0K |
| 描述： | MCU 8-BIT 768 RAM 4MHZ 80-QFP |
| 標準包裝： | 84 |
| 系列： | HC11 |
| 核心處理器： | HC11 |
| 芯體尺寸： | 8-位 |
| 速度： | 4MHz |
| 連通性： | SCI，SPI |
| 外圍設備： | POR，PWM，WDT |
| 輸入/輸出數： | 37 |
| 程序存儲器類型： | ROMless |
| EEPROM 大?。?/td> | 640 x 8 |
| RAM 容量： | 768 x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 4.5 V ~ 5.5 V |
| 數據轉換器： | A/D 8x8b |
| 振蕩器型： | 內部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 80-QFP |
| 包裝： | 托盤 |
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Technical Data
M68HC11K Family
172
Serial Peripheral Interface (SPI)
MOTOROLA
Serial Peripheral Interface (SPI)
CPOL selects an active high or low clock edge. CPHA selects one of two
transfer formats. When CPHA is cleared, the shift clock is ORed with SS.
Each slave’s SS pin must be pulled high before it writes the next output
byte to its data register. If a slave writes to its data register while SS is
low, a write collision error occurs. When CPHA is set, SS may be left low
for several SPI characters. When there is only one SPI slave MCU, its
SS line may be tied to VSS if CPHA = 1 at all times.
The SPI configuration determines the characteristics of a transfer in
progress. For a master, a transfer begins when data is written to SPDR
and ends when SPIF is set. For a slave with CPHA cleared, a transfer
starts when SS goes low and ends when SS returns high. In this case,
SPIF is set at the middle of the eighth SCK cycle when data is
transferred from the shifter to the parallel data register, but the transfer
is still in progress until SS goes high. For a slave with CPHA set, transfer
begins when the SCK line goes to its active level, which is the edge at
the beginning of the first SCK cycle. The transfer ends when SPIF is set.
SCK in a slave must be inactive for at least two E-clock cycles between
byte transfers.
8.5 SPI System Errors
Two types of errors can be detected by the SPI system:
A mode fault error can occur when multiple devices attempt to act
in master mode simultaneously.
A write collision error results from an attempt to write data to the
SPDR while a transmission is in progress.
8.5.1 Mode Fault Error
A mode fault error occurs when the SS input line of an SPI system
configured as a master goes to active low, usually because two devices
have attempted to act as master at the same time. The resulting
contention between push-pull CMOS pin drivers can cause them
permanent damage. The mode fault disables the drivers in an attempt to
protect them. The MSTR control bit in the SPCR and all four DDRD
F
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I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
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相關PDF資料 |
PDF描述 |
|---|---|
| MC68HC11K1CFUE3 | MCU 8-BIT 768 RAM 3MHZ 80-QFP |
| MC9S08AW16MFDE | IC MCU 8BIT 16K FLASH 48-QFN |
| MC68HC11K1CFNE4R | MCU 8-BIT 768 RAM 4MHZ 84-PLCC |
| MC68HC11K1CFNE3 | MCU 8-BIT 768 RAM 3MHZ 84-PLCC |
| MC68HC11K0CFUE4 | MCU 8-BIT 768 RAM 4MHZ 80-QFP |
相關代理商/技術參數 |
參數描述 |
|---|---|
| MC68HC11K1MFN2 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:8-Bit Microcontroller |
| MC68HC11K1MFN3 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Technical Summary 8-Bit Microcontroller |
| MC68HC11K1MFN4 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:8-Bit Microcontroller |
| MC68HC11K1VFN2 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:8-Bit Microcontroller |
| MC68HC11K1VFN3 | 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:Technical Summary 8-Bit Microcontroller |
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