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參數(shù)資料
| 型號： | MC68HC11P1CFN4R2 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, EEPROM, 4 MHz, MICROCONTROLLER, PQCC84 |
| 封裝： | PLASTIC, LCC-84 |
| 文件頁數(shù)： | 72/236頁 |
| 文件大?。?/td> | 1232K |
| 代理商： | MC68HC11P1CFN4R2 |
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MC68HC11P2
MOTOROLA
10-3
RESETS AND INTERRUPTS
10
COPRST — Arm/reset COP timer circuitry register
Complete the following reset sequence to service the COP timer. Write $55 to COPRST to arm
the COP timer clearing mechanism. Then write $AA to COPRST to clear the COP timer. Executing
instructions between these two steps is possible as long as both steps are completed in the
correct sequence before the timer times out.
10.1.4
Clock monitor reset
The clock monitor circuit is based on an internal RC time delay. If no MCU clock edges are
detected within this RC time delay, the clock monitor can optionally generate a system reset. The
clock monitor function is enabled or disabled by the CME control bit in the OPTION register. The
presence of a timeout is determined by the RC delay, which allows the clock monitor to operate
without any MCU clocks.
Clock monitor is used as a backup for the COP system. Because the COP needs a clock to
function, it is disabled when the clocks stop. Therefore, the clock monitor system can detect clock
failures not detected by the COP system.
Semiconductor wafer processing causes variations of the RC timeout values between individual
devices. An E clock frequency below 10 kHz is detected as a clock monitor error. An E clock
frequency of 200 kHz or more prevents clock monitor errors. Using the clock monitor function
when the E clock is below 200 kHz is not recommended.
Special considerations are needed when a STOP instruction is executed and the clock monitor is
enabled. Because the STOP function causes the clocks to be halted, the clock monitor function
generates a reset sequence if it is enabled at the time the STOP mode was initiated. Before
executing a STOP instruction, clear the CME bit in the OPTION register to zero to disable the clock
monitor. After recovery from STOP, set the CME bit to logic one to enable the clock monitor.
10.1.5
OPTION — System conguration options register 1
The special-purpose OPTION register sets internal system conguration options during initialization.
The time protected control bits (IRQE, DLY, FCME and CR[1:0]) can be written to only once in the rst
64 cycles after a reset and then they become read-only bits. This minimizes the possibility of any
accidental changes to the system conguration. They may be written at any time in special modes.
Address
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
State
on reset
COP timer arm/reset (COPRST)
$003A
(bit 7)
(6)
(5)
(4)
(3)
(2)
(1)
(bit 0) not affected
Address
bit 7
bit 6
bit 5
bit 4
bit 3
bit 2
bit 1
bit 0
State
on reset
System cong. options 1 (OPTION)
$0039
ADPU
CSEL
IRQE
DLY
CME
FCME
CR1
CR0
0001 0000
相關PDF資料 |
PDF描述 |
|---|---|
| MC68HC11P2BCFN4R2 | 8-BIT, MROM, 4 MHz, MICROCONTROLLER, PQCC84 |
| MC68HC11PH8CPV3 | 8-BIT, MROM, 3 MHz, MICROCONTROLLER, PQFP112 |
| MC68S711PH8CFN4 | 8-BIT, OTPROM, 4 MHz, MICROCONTROLLER, PQCC84 |
| MC68S711PH8CFS3 | 8-BIT, UVPROM, 3 MHz, MICROCONTROLLER, CQCC84 |
| MC68S11PH8CPV4 | 8-BIT, MROM, 4 MHz, MICROCONTROLLER, PQFP112 |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| MC68HC16Z1CAG | 制造商:Freescale Semiconductor 功能描述: |
| MC68HC16Z1CAG16 | 功能描述:16位微控制器 - MCU 16 BIT MCU 1K RAM RoHS:否 制造商:Texas Instruments 核心:RISC 處理器系列:MSP430FR572x 數(shù)據(jù)總線寬度:16 bit 最大時鐘頻率:24 MHz 程序存儲器大小:8 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:2 V to 3.6 V 工作溫度范圍:- 40 C to + 85 C 封裝 / 箱體:VQFN-40 安裝風格:SMD/SMT |
| MC68HC16Z1CAG16 | 制造商:Freescale Semiconductor 功能描述:IC16-BIT MICROCONTROLLER |
| MC68HC16Z1CAG20 | 功能描述:16位微控制器 - MCU 16 BIT MCU 1K RAM RoHS:否 制造商:Texas Instruments 核心:RISC 處理器系列:MSP430FR572x 數(shù)據(jù)總線寬度:16 bit 最大時鐘頻率:24 MHz 程序存儲器大小:8 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:2 V to 3.6 V 工作溫度范圍:- 40 C to + 85 C 封裝 / 箱體:VQFN-40 安裝風格:SMD/SMT |
| MC68HC16Z1CAG20 | 制造商:Freescale Semiconductor 功能描述:Microcontroller |
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