參數(shù)資料
型號： MC68HC908AS60VFN
廠商： MOTOROLA INC
元件分類： 微控制器/微處理器
英文描述： HCMOS Microcontroller Unit
中文描述： 8-BIT, FLASH, 8.4 MHz, MICROCONTROLLER, PQCC52
封裝： PLASTIC, LCC-52
文件頁數(shù)： 83/278頁
文件大?。?/td> 4699K
代理商： MC68HC908AS60VFN
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Functional Description
MC68HC908GT16 MC68HC908GT8 Data Sheet, Rev. 3
Freescale Semiconductor
83
Figure 7-5. Clock Monitor Block Diagram
To conserve size, the long divider (divide by 4096) is also used as an external crystal stabilization divider.
The divider is reset when the external clock generator is turned off or in stop mode (ECGEN is clear).
When the external clock generator is first turned on, the external clock generator stable bit (ECGS) will
be clear. This condition automatically selects ECLK as the input to the long divider. The external
stabilization clock (ESTBCLK) will be ECLK divided by 16 when EXTXTALEN is low or 4096 when
EXTXTALEN is high. This timeout allows the crystal to stabilize. The falling edge of ESTBCLK is used to
set ECGS, which will set after a full 16 or 4096 cycles. When ECGS is set, the divider returns to its normal
function. ESTBCLK may be generated by either IBASE or ECLK, but any clocking will only reinforce the
set condition. If ECGS is cleared because the clock monitor determined that ECLK was inactive, the
divider will revert to a stabilization divider. Since this will change the EREF and IREF divide ratios, it is
important to turn the clock monitor off (CMON = 0) after inactivity is detected to ensure valid recovery.
EXTXTALEN
EXTSLOW
FICGS
IOFF
CMON
FICGS
IBASE
ICGEN
EREF
IOFF
ICGS
IBASE
ICGON
EXTXTALEN
EXTSLOW
ECGS
ECLK
ECGEN
EREF
ESTBCLK
IREF
ESTBCLK
IREF
ECGEN
ECLK
CMON
ECGS
EOFF
CMON
EOFF
ECGS
ICGS
IBASE
ICGEN
ECLK
ECGEN
ICLK
ACTIVITY
DETECTOR
REFERENCE
GENERATOR
ECLK
ACTIVITY
DETECTOR
NAME
NAME
NAME
CONFIG2 REGISTER BIT
REGISTER BIT
MODULE SIGNAL
NAME
TOP LEVEL SIGNAL
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PDF描述
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