參數(shù)資料
型號(hào)： MC68HC908JW32
廠商： 飛思卡爾半導(dǎo)體(中國)有限公司
英文描述： Microcontrollers
中文描述： 微控制器
文件頁數(shù)： 80/226頁
文件大?。?/td> 1196K
代理商： MC68HC908JW32
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System Integration Module (SIM)
MC68HC908JW32 Data Sheet, Rev. 5
80
Freescale Semiconductor
6.4.2 SIM Counter During Stop Mode Recovery
The SIM counter also is used for stop mode recovery. The STOP instruction clears the SIM counter. After
an interrupt, break, or reset, the SIM senses the state of the short stop recovery bit, SSREC, in the mask
option register. If the SSREC bit is a logic 1, then the stop recovery is reduced from the normal delay of
4096 CGMXCLK cycles down to 32 CGMXCLK cycles. This is ideal for applications using canned
oscillators that do not require long start-up times from stop mode. External crystal applications should use
the full stop recovery time, that is, with SSREC cleared.
6.4.3 SIM Counter and Reset States
External reset has no effect on the SIM counter. (
See 6.6.2 Stop Mode
for details.) The SIM counter is
free-running after all reset states. (
See 6.3.2 Active Resets from Internal Sources
for counter control and
internal reset recovery sequences.)
6.5 Exception Control
Normal, sequential program execution can be changed in three different ways:
Interrupts:
–
Maskable hardware CPU interrupts
–
Non-maskable software interrupt instruction (SWI)
Reset
Break interrupts
6.5.1 Interrupts
At the beginning of an interrupt, the CPU saves the CPU register contents on the stack and sets the
interrupt mask (I bit) to prevent additional interrupts. At the end of an interrupt, the RTI instruction recovers
the CPU register contents from the stack so that normal processing can resume.
Figure 6-8
shows
interrupt entry timing, and
Figure 6-9
shows interrupt recovery timing.
Figure 6-8. Interrupt Entry Timing
Figure 6-9. Interrupt Recovery Timing
MODULE
INTERRUPT
IDB
R/W
DUMMY
SP
SP – 1
SP – 2
SP – 3
SP – 4
VECT H
VECT L
START ADDR
IAB
DUMMY
PC – 1[7:0] PC – 1[15:8]
X
A
CCR
V DATA H
V DATA L
OPCODE
I-BIT
MODULE
INTERRUPT
IDB
R/W
SP – 4
SP – 3
SP – 2
SP – 1
SP
PC
PC + 1
IAB
CCR
A
X
PC – 1[15:8] PC – 1[7:0]
OPCODE
OPERAND
I-BIT
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PDF描述
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