參數(shù)資料
型號： MC68HC908KK3ECDW
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 8-BIT, FLASH, 4 MHz, MICROCONTROLLER, PDSO20
封裝： 1.27 MM PITCH, MS-013AC, SOIC-20
文件頁數(shù)： 30/180頁
文件大?。?/td> 2412K
代理商： MC68HC908KK3ECDW
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COP Control Register
MC68HC908JL3E Family Data Sheet, Rev. 4
Freescale Semiconductor
125
13.3.7 COPRS (COP Rate Select)
The COPRS signal reflects the state of the COP rate select bit (COPRS) in the configuration register 1.
COPRS — COP Rate Select Bit
COPRS selects the COP timeout period. Reset clears COPRS.
1 = COP timeout period is 8176
× 2OSCOUT cycles
0 = COP timeout period is 262,128
× 2OSCOUT cycles
COPD — COP Disable Bit
COPD disables the COP module.
1 = COP module disabled
0 = COP module enabled
13.4 COP Control Register
The COP control register is located at address $FFFF and overlaps the reset vector. Writing any value to
$FFFF clears the COP counter and starts a new timeout period. Reading location $FFFF returns the low
byte of the reset vector.
13.5 Interrupts
The COP does not generate CPU interrupt requests.
13.6 Monitor Mode
The COP is disabled in monitor mode when VTST is present on the IRQ pin or on the RST pin.
13.7 Low-Power Modes
The WAIT and STOP instructions put the MCU in low-power consumption standby modes.
Address:
$001F
Bit 7
6
54
321
Bit 0
Read:
COPRS
R
LVID
R
SSREC
STOP
COPD
Write:
Reset:
00
000
0
R= Reserved
Figure 13-2. Configuration Register 1 (CONFIG1)
Address:
$FFFF
Bit 7
654321
Bit 0
Read:
Low byte of reset vector
Write:
Clear COP counter
Reset:
Unaffected by reset
Figure 13-3. COP Control Register (COPCTL)
相關(guān)PDF資料
PDF描述
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