參數(shù)資料
型號： MC68HC908LB8_05
廠商： 飛思卡爾半導(dǎo)體(中國)有限公司
英文描述： M68HC08 Microcontrollers
中文描述： M68HC08系列微控制器
文件頁數(shù)： 211/234頁
文件大?。?/td> 1261K
代理商： MC68HC908LB8_05
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Monitor Module (MON)
MC68HC908LB8 Data Sheet, Rev. 1
Freescale Semiconductor
211
Figure 19-10. Normal Monitor Mode Circuit (External Clock, with High Voltage)
The monitor code has been updated from previous versions of the monitor code to allow enabling the
internal oscillator to generate the internal clock. This addition, which is enabled when IRQ is held low out
of reset, is intended to support serial communication/programming at 9600 baud in monitor mode by using
the internal oscillator, and the internal oscillator user trim value OSCTRIM (FLASH location $FFC0, if
programmed) to generate the desired internal frequency (4.0 MHz). Since this feature is enabled only
when IRQ is held low out of reset, it cannot be used when the reset vector is programmed (i.e., the value
is not $FFFF) because entry into monitor mode in this case requires V
TST
on IRQ.
Enter monitor mode with pin configuration shown in
Figure 19-11
by pulling RST low and then high. The
rising edge of RST latches monitor mode. Once monitor mode is latched, the values on the specified pins
can change.
Once out of reset, the MCU waits for the host to send eight security bytes (see
19.3.2 Security
). After the
security bytes, the MCU sends a break signal (10 consecutive 0s) to the host, indicating that it is ready to
receive a command.
9.8304 MHz CLOCK
+
10 k
*
V
DD
10 k
*
RST (PTA5)
IRQ (PTC2)
PTA0
0.1
μ
F
OSC1 (PTC0)
8
7
DB9
2
3
5
16
15
2
6
10
9
V
DD
MAX232
V+
V–
1
μ
F
+
1
2
3
4
5
6
74HC125
74HC125
10 k
PTA1
PTA4
V
SS
0.1
μ
F
V
DD
1 k
9.1 V
C1+
C1–
5
4
1
μ
F
C2+
C2–
+
3
1
1
μ
F
+
1
μ
F
V
DD
+
1
μ
F
V
TST
* Value not critical
V
DD
V
DD
10 k
*
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PDF描述
MC68HC908LB8 On-Chip FLASH Programming Routines
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參數(shù)描述
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