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參數(shù)資料
| 型號： | MC68HC908SR12CFA |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 265/404頁 |
| 文件大?。?/td> | 0K |
| 描述： | MICROCONTROLLER 48 PIN |
| 標(biāo)準(zhǔn)包裝： | 250 |
| 系列： | HC08 |
| 核心處理器： | HC08 |
| 芯體尺寸： | 8-位 |
| 速度： | 8MHz |
| 連通性： | I²C，SCI |
| 外圍設(shè)備： | LVD，POR，PWM，溫度傳感器 |
| 輸入/輸出數(shù)： | 31 |
| 程序存儲器容量： | 12KB（12K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 512 x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 2.7 V ~ 5.5 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 14x10b |
| 振蕩器型： | 內(nèi)部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 48-LQFP |
| 包裝： | 托盤 |
| 其它名稱： | Q1145673 |
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External Interrupt (IRQ)
Functional Description
MC68HC908SR12MC68HC08SR12 — Rev. 5.0
Data Sheet
Freescale Semiconductor
External Interrupt (IRQ)
337
When an interrupt pin is edge-triggered only, the interrupt remains set
until a vector fetch, software clear, or reset occurs.
When an interrupt pin is both falling-edge and low-level-triggered, the
interrupt remains set until both of the following occur:
Vector fetch or software clear
Return of the interrupt pin to logic 1
The vector fetch or software clear may occur before or after the interrupt
pin returns to logic 1. As long as the pin is low, the interrupt request
remains pending. A reset will clear the latch and the MODE1 control bit,
thereby clearing the interrupt even if the pin stays low.
When set, the IMASK bit in the INTSCR mask all external interrupt
requests. A latched interrupt request is not presented to the interrupt
priority logic unless the IMASK bit is clear.
NOTE:
The interrupt mask (I) in the condition code register (CCR) masks all
interrupt requests, including external interrupt requests.
Figure 19-2. IRQ1 Block Diagram
ACK1
IMASK1
DQ
CK
CLR
IRQ1
HIGH
INTERRUPT
TO MODE
SELECT
LOGIC
IRQ1
FF
REQUEST
VDD
MODE1
VOLTAGE
DETECT
SYNCHRO-
NIZER
IRQ1F
TO CPU FOR
BIL/BIH
INSTRUCTIONS
VECTOR
FETCH
DECODER
INTERN
AL
ADDRESS
BUS
RESET
V
DD
INTERNAL
PULLUP
DEVICE
IRQ1
發(fā)布緊急采購，3分鐘左右您將得到回復(fù)。