參數(shù)資料
型號(hào)： MC68HC916R1
廠商： Motorola, Inc.
英文描述： 16-Bit Modular Microcontroller(16位模塊化微控制器)
中文描述： 16位微控制器模塊（16位模塊化微控制器）
文件頁數(shù)： 149/357頁
文件大小： 1822K
代理商： MC68HC916R1
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MC68HC16R1/916R1
USER’S MANUAL
SINGLE-CHIP INTEGRATION MODULE 2
MOTOROLA
5-53
5.7.5.1 Reset States of SCIM2 Pins
Generally, while RESET is asserted, SCIM2 pins either go to an inactive high-
impedance state or are driven to their inactive states. After RESET is released, mode
selection occurs, and reset exception processing begins. Pins configured as inputs
must be driven to the desired active state. Pull-up or pull-down circuitry may be
necessary. Pins configured as outputs begin to function after RESET is released.
Table 5-21
is a summary of SCIM2 pin states during reset.
5.7.5.2 Reset States of Pins Assigned to Other MCU Modules
As a rule, module pins that are assigned to general-purpose I/O ports go into a high-
impedance state following reset. However, during power-on reset, module port pins
may be in an indeterminate state for a short period. Refer to
5.7.7 Power-On Reset
for more information.
Table 5-21 SCIM2 Pin Reset States
Pin(s)
Pin State
While RESET
Asserted
Pin State After RESET Released
Default Function
Pin Function
Pin State
CS10
V
DD
CS[9:6]
V
DD
ADDR[18:0]
Unknown
AS
Output
AVEC
Input
BERR
Input
CS1
V
DD
CS2
V
DD
CS0
V
DD
CLKOUT
Output
CSBOOT
V
SS
DATA[15:0]
Input
DS
Output
DSACK0
Input
DSACK1
Input
CS[5:3]
V
DD
HALT
Input
IRQ[7:1]
Input
FASTREF
Input
R/W
Output
RESET
Input
SIZ[1:0]
Unknown
TSC
Input
Alternate Function
Pin Function
ADDR23
ADDR[22:19]
ADDR[18:0]
PE5
PE2
BERR
BG
BGACK
BR
CLKOUT
CSBOOT
DATA[15:0]
PE4
PE0
PE1
FC[2:0]
HALT
PF[7:1]
PF0
R/W
RESET
PE[7:6]
TSC
Pin State
Unknown
Unknown
Unknown
Input
Input
Input
V
DD
Input
Input
Output
V
SS
Input
Input
Input
Input
Unknown
Input
Input
Input
Output
Input
Input
Input
CS10/ADDR23/ECLK
CS[9:6]/ADDR[22:19]/PC[6:3]
ADDR[18:0]
AS/PE5
AVEC/PE2
BERR
CSM/BG
CSE/BGACK
CS0/BR
CLKOUT
CSBOOT
DATA[15:0]
DS/PE4
DSACK0/PE0
DSACK1/PE1
CS[5:3]/FC[2:0]/PC[2:0]
HALT
IRQ[7:1]/PF[7:1]
FASTREF/PF0
R/W
RESET
SIZ[1:0]/PE[7:6]
TSC
V
DD
V
DD
High-Z
High-Z
High-Z
High-Z
V
DD
V
DD
V
DD
Output
V
DD
Mode select
High-Z
High-Z
High-Z
V
DD
High-Z
High-Z
Mode Select
High-Z
Asserted
High-Z
Mode select
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