參數(shù)資料
型號(hào): MC68HRC98JK1EMP
廠商: FREESCALE SEMICONDUCTOR INC
元件分類: 微控制器/微處理器
英文描述: 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PDIP20
封裝: PLASTIC, DIP-20
文件頁數(shù): 155/180頁
文件大?。?/td> 2412K
代理商: MC68HRC98JK1EMP
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Monitor ROM (MON)
MC68HC908JL3E Family Data Sheet, Rev. 4
76
Freescale Semiconductor
7.3.3 Data Format
Communication with the monitor ROM is in standard non-return-to-zero (NRZ) mark/space data format.
Figure 7-3. Monitor Data Format
Figure 7-4. Sample Monitor Waveforms
The data transmit and receive rate can be anywhere from 4800 baud to 28.8k-baud. Transmit and receive
baud rates must be identical.
7.3.4 Echoing
As shown in Figure 7-5, the monitor ROM immediately echoes each received byte back to the PTB0 pin
for error checking.
Figure 7-5. Read Transaction
Any result of a command appears after the echo of the last byte of the command.
7.3.5 Break Signal
A start bit followed by nine low bits is a break signal. (See Figure 7-6.) When the monitor receives a break
signal, it drives the PTB0 pin high for the duration of two bits before echoing the break signal.
Figure 7-6. Break Transaction
BIT 5
START
BIT
BIT 0
BIT 1
NEXT
STOP
BIT
START
BIT
BIT 2
BIT 3
BIT 4
BIT 6
BIT 5
START
BIT
BIT 0
BIT 1
NEXT
STOP
BIT
START
BIT
BIT 2
BIT 3
BIT 4
BIT 6
BIT 7
START
BIT
BIT 0
BIT 1
NEXT
STOP
BIT
START
BIT
BIT 2
$A5
BREAK
BIT 3
BIT 4
BIT 5
BIT 6
BIT 7
ADDR. HIGH
READ
ADDR. HIGH
ADDR. LOW
DATA
ECHO
SENT TO
MONITOR
RESULT
0
1
2
3
4
5
6
7
0
1
2
3
4
5
6
7
MISSING STOP BIT
TWO-STOP-BIT DELAY BEFORE ZERO ECHO
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PDF描述
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參數(shù)描述
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