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參數(shù)資料
| 型號(hào)： | MC68LC040FE33A |
| 廠商： | Freescale Semiconductor |
| 文件頁(yè)數(shù)： | 290/442頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC MPU 32BIT 33MHZ 184-CQFP |
| 標(biāo)準(zhǔn)包裝： | 24 |
| 系列： | M680x0 |
| 處理器類(lèi)型： | M680x0 32-位 |
| 速度： | 33MHz |
| 電壓： | 5V |
| 安裝類(lèi)型： | 表面貼裝 |
| 封裝/外殼： | 184-BCQFP |
| 供應(yīng)商設(shè)備封裝： | 184-CQFP（31.3x31.3） |
| 包裝： | 托盤(pán) |
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MOTOROLA
M68040 USER’S MANUAL
1- 15
Table 1-4. Instruction Set Summary (Continued)
Opcode
Operation
Syntax
BTST
–(bit number of Destination) Z;
BTST Dn,<ea>
BTST #<data>,<ea>
CAS
CAS Destination – Compare Operand cc;
if Z, Update Operand Destination
else Destination Compare Operand
CAS Dc,Du,<ea>
CAS2
CAS2 Destination 1 – Compare 1 cc;
if Z, Destination 2 – Compare cc;
if Z, Update 1 Destination 1;
Update 2 Destination 2
else Destination 1 Compare 1;
Destination 2 Compare 2
CAS2 Dc1–Dc2,Du1–Du2,(Rn1)–(Rn2)
CHK
If Dn < 0 or Dn > Source
then TRAP
CHK <ea>,Dn
CHK2
If Rn < LB or If Rn > UB
then TRAP
CHK2 <ea>,Rn
CINV
If supervisor state
then invalidate selected cache lines
else TRAP
CINVL <caches>, (An)
CINVP <caches>, (An)
CINVA <caches>
CLR
0 Destination
CLR <ea>
CMP
Destination – Source cc
CMP <ea>,Dn
CMPA
Destination – Source
CMPA <ea>,An
CMPI
Destination – Immediate Data
CMPI #<data>,<ea>
CMPM
Destination – Source cc
CMPM (Ay)+,(Ax)+
CMP2
Compare Rn < LB or Rn > UB
and Set Condition Codes
CMP2 <ea>,Rn
CPUSH
If supervisor state
then if data cache push selected dirty data
cache lines; invalidate selected cache lines
else TRAP
CPUSHL <caches>, (An)
CPUSHP <caches>, (An)
CPUSHA <caches>
DBcc
If condition false
then (Dn–1 Dn;
If Dn
≠ –1
then PC + d n PC)
DBcc Dn,<label>
DIVS, DIVSL
Destination
÷ Source Destination
DIVS.W <ea>,Dn
32
÷ 16 16r:16q
DIVS.L <ea>,Dq
32
÷ 32 32q
DIVS.L <ea>,Dr:Dq
64
÷ 32 32r:32q
DIVSL.L <ea>,Dr:Dq
32
÷ 32 32r:32q
DIVU, DIVUL
Destination
÷ Source Destination
DIVU.W <ea>,Dn
32
÷ 16 16r:16q
DIVU.L <ea>,Dq
32
÷ 32 32q
DIVU.L <ea>,Dr:Dq
64
÷ 32 32r:32q
DIVUL.L <ea>,Dr:Dq
32
÷ 32 32r:32q
EOR
Source
⊕ Destination Destination
EOR Dn,<ea>
EORI
Immediate Data
⊕ Destination Destination
EORI #<data>,<ea>
EORI to CCR
Source
⊕ CCR CCR
EORI #<data>,CCR
EORI to SR
If supervisor state
then Source
⊕ SR SR
else TRAP
EORI #<data>,SR
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| ABB108DHAN | CONN EDGECARD 216PS R/A .050 SLD |
| IDT709359L9BF | IC SRAM 144KBIT 9NS 100FBGA |
| MPC8568ECVTAQGG | MPU POWERQUICC III 1023-PBGA |
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| IDT709169L9BF | IC SRAM 144KBIT 9NS 100FBGA |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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