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參數(shù)資料
| 型號： | MC68VZ328VF33VR2 |
| 廠商： | MOTOROLA INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | MICROCONTROLLER, PBGA144 |
| 封裝： | 13 X 13 MM, 1 MM PITCH, MOLD ARRAY PROCESS, PLASTIC, BGA-144 |
| 文件頁數(shù)： | 11/284頁 |
| 文件大小： | 5173K |
| 代理商： | MC68VZ328VF33VR2 |
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6-20
MC68VZ328 User’s Manual
Programming Model
6.3.7 Chip-Select Control Register 3
This register controls minor timing trims for static memory access.
CSCTRL3
Chip-Select Control Register 3
0x(FF)FFF150
Example 6-2 on page 6-21 demonstrates how to initialize the chip-select with a particular memory
configuration.
BIT 15
14
13
12
11
10
9
8
7654321
BIT 0
EWE
WPEXT
LCWS
AST
DST
CST
TYPE
rw
RESET
1
0
1
0
0000000
0
0x9C00
Table 6-14. Chip-Select Control Register 3 Description
Name
Description
Setting
EWE
Bit 15
End Write Early—When this bit is set, the
RAM write-enable signal negates before the
CS signal is negated.
0 = Disabled.
1 = Enabled.
WPEXT
Bit 14
Write Pulse to CS Negation Margin
Extension—When EWE is set, WPEXT is set
to extend the WE negation to CS negation by
one more clock.
0 = Disabled.
1 = Enabled.
LCWS
Bit 13
Wait State Trim for LCD-SRAM
Access—When this bit is set, one additional
wait state is added to the LCD-SRAM access
cycle. For example, if the wait state is set to
zero, all CPU accesses require 4 cycles to
complete, the chip-select signal to SRAM lasts
2.5 CPU clock cycles, and 2 cycles are used
for LCD access. When LCWS is enabled, the
LCD access is delayed; the access is
increased from 2 to 3 clock cycles.
0 = No additional wait state added.
1 = One additional wait state added.
AST
Bit 12
AS Toggle Enable—Enables AS toggling
between two 8-bit transfers.
0 = Disable AS toggling between two 8-bit
transfers.
1 = Enable AS toggling between two 8-bit
transfers.
DST
Bit 11
DS Toggle Enable—Enables DS toggling
between two 8-bit transfers.
0 = Disable DS toggling between two 8-bit
transfers.
1 = Enable DS toggling between two 8-bit
transfers.
CST
Bit 10
CS Toggle Enable—Enables CS toggling
between two 8-bit transfers.
0 = Disable CS toggling between two 8-bit
transfers.
1 = Enable CS toggling between two 8-bit
transfers.
Reserved
Bits 9
–0
Reserved
These bits are reserved and should be set to
0.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MC68VZ328VF33V | MICROCONTROLLER, PBGA144 |
| MC68VZ328CPV33V | MICROCONTROLLER, PQFP144 |
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| MCAQE32G8APP-0XA | FLASH MEMORY DRIVE CONTROLLER, PQFP |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| MC68VZ328VPR2 | 功能描述:IC MPU 32BIT 144-MAPBGA RoHS:是 類別:集成電路 (IC) >> 嵌入式 - 微處理器 系列:M683xx 標(biāo)準(zhǔn)包裝:1 系列:MPC85xx 處理器類型:32-位 MPC85xx PowerQUICC III 特點(diǎn):- 速度:1.2GHz 電壓:1.1V 安裝類型:表面貼裝 封裝/外殼:783-BBGA，F(xiàn)CBGA 供應(yīng)商設(shè)備封裝:783-FCPBGA（29x29） 包裝:托盤 |
| MC690 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:INTEGRATED CIRCUITS |
| MC691 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:INTEGRATED CIRCUITS |
| MC693 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:INTEGRATED CIRCUITS |
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