參數(shù)資料
型號： MC74LVX74M
廠商： ON SEMICONDUCTOR
元件分類： 通用總線功能
英文描述： LOW-VOLTAGE CMOS
中文描述： LV/LV-A/LVX/H SERIES, DUAL POSITIVE EDGE TRIGGERED D FLIP-FLOP, COMPLEMENTARY OUTPUT, PDSO14
封裝： EIAJ, SO-14
文件頁數(shù)： 1/7頁
文件大?。?/td> 153K
代理商： MC74LVX74M
SEMICONDUCTOR TECHNICAL DATA
1
REV 0
Motorola, Inc. 1997
6/97
"
!
The MC74LVX74 is an advanced high speed CMOS D–type flip–flop.
The inputs tolerate voltages up to 7V, allowing the interface of 5V systems
to 3V systems.
The signal level applied to the D input is transferred to O output during
the positive going transition of the Clock pulse.
Clear (CD) and Set (SD) are independent of the Clock (CP) and are
accomplished by setting the appropriate input Low.
High Speed: fmax = 145MHz (Typ) at VCC = 3.3V
Low Power Dissipation: ICC = 2
μ
A (Max) at TA = 25
°
C
Power Down Protection Provided on Inputs
Balanced Propagation Delays
Low Noise: VOLP = 0.5V (Max)
Pin and Function Compatible with Other Standard Logic Families
Latchup Performance Exceeds 300mA
ESD Performance: HBM > 2000V; Machine Model > 200V
Figure 1. 14–Lead Pinout
(Top View)
13
14
12
11
10
9
8
2
1
3
4
5
6
7
VCC
CD2
D2
CP2
SD2
O2
O2
CD1
D1
CP1
SD1
O1
O1
GND
LOW–VOLTAGE CMOS
D SUFFIX
14–LEAD SOIC PACKAGE
CASE 751A–03
DT SUFFIX
14–LEAD TSSOP PACKAGE
CASE 948G–01
M SUFFIX
14–LEAD SOIC EIAJ PACKAGE
CASE 965–01
PIN NAMES
Function
Clock Pulse Inputs
Data Inputs
Direct Clear Inputs
Direct Set Inputs
Outputs
Pins
CP1, CP2
D1, D2
CD1, CD2
SD1, SD2
On, On
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PDF描述
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參數(shù)描述
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