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參數(shù)資料
| 型號(hào)： | MC80C52CXXX-16P883 |
| 廠商： | TEMIC SEMICONDUCTORS |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 16 MHz, MICROCONTROLLER, CDIP40 |
| 文件頁(yè)數(shù)： | 257/326頁(yè) |
| 文件大?。?/td> | 3228K |
| 代理商： | MC80C52CXXX-16P883 |
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36
7734Q–AVR–02/12
AT90PWM81/161
Figure 5-5.
Fuses substitution and clock source selection.
When ‘Enable/Disable Clock Source’, ‘Request for Clock Availability’ or ‘Clock Source Switching’
command is entered, the selected configuration provided by the CLKSELR register is latched for
each targeted clock source.
‘Recover System Clock Source’ command enables the code recovering of clock source used to
drive the system clock. The CKSEL field of CLKSELR register is then updated with this code.
There is no information on the SUT used or status on CKOUT.
Because the selected configuration is latched at clock source level, it is possible to enable many
clock sources at a given time (ex: the internal RC oscillator for system clock + an oscillator with
external crystal). The user’s software has the responsibility of this management.
‘Request for Clock Availability’ command returns the working order of the clock source
addressed. The status is set in the CLKRDY bit of CLKCSR register.
5.3.4
Enable/Disable Clock Source
‘Enable Clock Source’ command selects and enables the clock source provided by the setting of
CLKSELR register (CSEL3..0 and CSUT1:0). CSEL field will select the clock source and CSUT
field will select the start-up time (as CKSEL and SUT fuse bits do it). To be sure that a clock
source has been enabled, it will be better to perform a ‘Request for Clock Availability’ command
after the ‘Enable Clock Source’ command.
‘Disable Clock Source’ command disables the clock source provided by the setting of CLKSELR
register (only CSEL3..0). If the clock source is the one that is used to drive the system clock, the
command is not taken into account.
5.3.5
Clock Availability
‘Request for Clock Availability’ command enables an oscillation-counting of the selected source
clock, CSEL3..0. The count is provided by CSUT1..0. The clock is declared ready (CLKRDY = 1)
when the count is finished. This flag remains unchanged up to a new count. The CLKRDY flag is
reset when the count starts. To perform this checking, the CKSEL and CSUT fields should not
change all long the operation is running.
Two usages are possible:
CLKSEL[3..0]
SUT[1..0]
CKOUT
Register:
CLKSELR
Fuse:
Fuse Low Byte
CSEL[3..0]
CSUT[1..0]
COUT
Default
R/W
Reg.
SEL
Decodeur
SEL-1
SEL-0
SEL-2
SEL-n
CKSEL[3..0]
SUT[1..0]
SEL
Encodeur
EN-1
EN-0
EN-2
EN-n
CKOUT
Reset
SCLKRq
(*)
SCLKRq
(*): Command of Clock Control & Status Register
Internal
Data
Bus
Selected
Configuration
Clock
Switch
Current
Configuration
相關(guān)PDF資料 |
PDF描述 |
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| MC80C52EXXX-30SHXXX:D | 8-BIT, MROM, 30 MHz, MICROCONTROLLER, CDIP40 |
| MR80C52EXXX-12:R | 8-BIT, MROM, 12 MHz, MICROCONTROLLER, CQCC44 |
| MR80C52EXXX-25:D | 8-BIT, MROM, 25 MHz, MICROCONTROLLER, CQCC44 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| MC80F0104B | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:8-BIT SINGLE-CHIP MICROCONTROLLERS |
| MC80F0104D | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:8-BIT SINGLE-CHIP MICROCONTROLLERS |
| MC80F0204 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:8-BIT SINGLE-CHIP MICROCONTROLLERS |
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