參數(shù)資料
型號： MC88916DW70
廠商： INTEGRATED DEVICE TECHNOLOGY INC
元件分類： 時鐘及定時
英文描述： 88916 SERIES, PLL BASED CLOCK DRIVER, 5 TRUE OUTPUT(S), 1 INVERTED OUTPUT(S), PDSO20
封裝： PLASTIC, SOIC-20
文件頁數(shù)： 8/10頁
文件大?。?/td> 503K
代理商： MC88916DW70
MC88916
TIMING SOLUTIONS
BR1333 — REV 5
7
MOTOROLA
Figure 3. MC68040 PCLK Input Termination Scheme
88916
2X_Q
OUTPUT
68040
PCLK
CLOCK
INPUT
Rs = Zo – 7
Rs
Zo (CLOCK
TRACE)
Figure 5. Logical Representation of the MC88916 With
Input/Output Frequency Relationships
2X_Q
Q0
Q1
Q2
Q3
Q/2
RST_OUT
SYNC
MR
PLL_EN
RST_IN
16.5MHz
CRYSTAL
OSCILLATOR
66MHz PCLK OUTPUT
33MHz
B–CLOCK
AND SYSTEM
OUTPUTS
ANALOG GND
CL
VCC
1K
RST_OUT PIN
INTERNAL
LOGIC
Figure 4. RST_OUT Test Circuit
RP
RP = 1.5Zo
Figure 6. Output/Input Switching Waveforms and Timing Relationships
SYNC Input
Q0–Q2 Outputs
Q3 Output
2X_Q Output
Q/2 Output
tCYCLE SYNC Input
tSKEWall
tSKEWf
tSKEWr
tSKEWf
tSKEWr
tCYCLE ‘Q’ Outputs
Timing Notes
1. The MC88916 aligns rising edges of the outputs and the SYNC input, therefore the SYNC input does not require a 50%
duty cycle.
2. All skew specs are measured between the VCC/2 crossing point of the appropriate output edges. All skews are specified as
‘windows’, not as a
± deviation around a center point.
F
re
e
sc
a
le
S
e
m
ic
o
n
d
u
c
to
r,
I
Freescale Semiconductor, Inc.
For More Information On This Product,
Go to: www.freescale.com
n
c
..
.
MC88916
Low Skew CMOS PLL Clock Drivers With Processor Reset
NETCOM
IDT Low Skew CMOS PLL Clock Drivers With Processor Reset
Freescale Timing Solutions Organization has been acquired by Integrated Device Technology, Inc
MC88916
7
相關(guān)PDF資料
PDF描述
MC88921DW 88921 SERIES, PLL BASED CLOCK DRIVER, 5 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PDSO20
MC88LV915TFN 88LV SERIES, PLL BASED CLOCK DRIVER, 7 TRUE OUTPUT(S), 1 INVERTED OUTPUT(S), PQCC28
MC88LV926DW 88LV SERIES, PLL BASED CLOCK DRIVER, 4 TRUE OUTPUT(S), 1 INVERTED OUTPUT(S), PDSO20
MD2FLDL-TTL-35G ACTIVE DELAY LINE, TRUE OUTPUT, DSO6
MD2FLDL-TTL-7F ACTIVE DELAY LINE, TRUE OUTPUT, DIP6
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參數(shù)描述
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