Pullup resistors<" />
參數(shù)資料
型號： MC908AP32CBE
廠商： Freescale Semiconductor
文件頁數(shù)： 231/324頁
文件大?。?/td> 0K
描述： IC MCU 32K FLASH 8MHZ 42DIP
標準包裝： 13
系列： HC08
核心處理器： HC08
芯體尺寸： 8-位
速度： 8MHz
連通性： I²C，IRSCI，SCI，SPI
外圍設(shè)備： LED，LVD，POR，PWM
輸入/輸出數(shù)： 30
程序存儲器容量： 32KB（32K x 8）
程序存儲器類型： 閃存
RAM 容量： 2K x 8
電壓 - 電源 (Vcc/Vdd)： 2.7 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 8x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 42-SDIP（0.600"，15.24mm）
包裝： 管件
產(chǎn)品目錄頁面： 726 (CN2011-ZH PDF)
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Electrical Specifications
MC68HC908AP Family Data Sheet, Rev. 4
304
Freescale Semiconductor
22.10 3V Control Timing
Pullup resistors(10)
PTD[0:7]
RST, IRQ1, IRQ2
RPU1
RPU2
21
27
39
k
k
Low-voltage inhibit, trip falling voltage1(11)
VTRIPF1
2.25
2.45
2.65
V
Low-voltage inhibit, trip rising voltage1(10)
VTRIPR1
2.35
2.55
2.75
V
Low-voltage inhibit, trip voltage2(10)
VTRIPF2
2.25
2.45
2.65
V
VREG
(10), (12)
VREG
2.25
2.50
2.75
V
1. VDD = 2.7 to 3.3 Vdc, VSS = 0 Vdc, TA = TL to TH, unless otherwise noted.
2. Typical values reflect average measurements at midpoint of voltage range, 25
°C only.
3. At VDD = 3V, an on-chip charge pump is activated for the VREG regulator, therefore some IDD values will appear higher
than the IDD values at VDD = 5V.
4. Run (operating) IDD measured using external 16MHz/32MHz clock to OSC1; all inputs 0.2 V from rail; no dc loads; less
than 100 pF on all outputs; CL = 20 pF on OSC2; all ports configured as inputs; OSC2 capacitance linearly affects run IDD;
measured with all modules enabled.
5. Wait IDD measured using external 16MHz/32MHz clock to OSC1; all inputs 0.2 V from rail; no dc loads; less than 100 pF
on all outputs. CL = 20 pF on OSC2; all ports configured as inputs; OSC2 capacitance linearly affects wait IDD.
6. STOP IDD measured with external 32.768kHz clock to OSC1; no port pins sourcing current.
7. STOP IDD measured with OSC1 grounded; no port pins sourcing current.
8. Maximum is highest voltage that POR is guaranteed. The rearm voltage is triggered by VREG.
9. If minimum VDD is not reached before the internal POR reset is released, RST must be driven low externally until minimum
VDD is reached.
10. RPU1 and RPU2 are measured at VDD = 5.0V
11. Values are not affected by operating VDD; they are the same for 3V and 5V.
12. Measured from VDD = VTRIPF1 (Min) to 5.5 V.
Table 22-9. Control Timing (3V)
Characteristic(1)
1. VDD = 2.7 to 3.3 Vdc, VSS = 0 Vdc; timing shown with respect to 20% VDD and 70% VDD, unless otherwise noted.
Symbol
Min
Max
Unit
Internal operating frequency(2)
2. Some modules may require a minimum frequency greater than dc for proper operation; see appropriate table for this in-
formation.
fOP
—
8
MHz
RST input pulse width low(3)
3. Minimum pulse width reset is guaranteed to be recognized. It is possible for a smaller pulse width to cause a reset.
tIRL
750
—
ns
Table 22-8. DC Electrical Characteristics (3V)
Characteristic(1)
Symbol
Min
Typ(2)
Max
Unit
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PDF描述
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MC908AP48CFBE 制造商:Freescale Semiconductor 功能描述:
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