MMIIC Control Reg" />
參數(shù)資料
型號： MC908AP32CFAE
廠商： Freescale Semiconductor
文件頁數(shù)： 154/324頁
文件大?。?/td> 0K
描述： IC MCU 32K FLASH 8MHZ 48-LQFP
標準包裝： 250
系列： HC08
核心處理器： HC08
芯體尺寸： 8-位
速度： 8MHz
連通性： I²C，IRSCI，SCI，SPI
外圍設備： LED，LVD，POR，PWM
輸入/輸出數(shù)： 32
程序存儲器容量： 32KB（32K x 8）
程序存儲器類型： 閃存
RAM 容量： 2K x 8
電壓 - 電源 (Vcc/Vdd)： 2.7 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 8x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 48-LQFP
包裝： 托盤
產(chǎn)品目錄頁面： 726 (CN2011-ZH PDF)
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MMIIC I/O Registers
MC68HC908AP Family Data Sheet, Rev. 4
Freescale Semiconductor
235
14.6.2
MMIIC Control Register 1 (MMCR1)
MMEN — MMIIC Enable
This bit is set to enable the Multi-master IIC module. When MMEN = 0, module is disabled and all flags
will restore to its power-on default states. Reset clears this bit.
1 = MMIIC module enabled
0 = MMIIC module disabled
MMIEN — MMIIC Interrupt Enable
When this bit is set, the MMTXIF, MMRXIF, MMALIF, and MMNAKIF flags are enabled to generate an
interrupt request to the CPU. When MMIEN is cleared, the these flags are prevented from generating
an interrupt request. Reset clears this bit.
1 = MMTXIF, MMRXIF, MMALIF, and/or MMNAKIF bit set will generate interrupt request to CPU
0 = MMTXIF, MMRXIF, MMALIF, and/or MMNAKIF bit set will not generate interrupt request to CPU
MMCLRBB — MMIIC Clear Busy Flag
Writing a logic 1 to this write-only bit clears the MMBB flag. MMCLRBB always reads as a logic 0.
Reset clears this bit.
1 = Clear MMBB flag
0 = No affect on MMBB flag
MMTXAK — MMIIC Transmit Acknowledge Enable
This bit is set to disable the MMIIC from sending out an acknowledge signal to the bus at the 9th clock
bit after receiving 8 data bits. When MMTXAK is cleared, an acknowledge signal will be sent at the 9th
clock bit. Reset clears this bit.
1 = MMIIC does not send acknowledge signals at 9th clock bit
0 = MMIIC sends acknowledge signal at 9th clock bit
REPSEN — Repeated Start Enable
This bit is set to enable repeated START signal to be generated when in master mode transfer
(MMAST = 1). The REPSEN bit is cleared by hardware after the completion of repeated START signal
or when the MMAST bit is cleared. Reset clears this bit.
1 = Repeated START signal will be generated if MMAST bit is set
0 = No repeated START signal will be generated
MMCRCBYTE — MMIIC CRC Byte
In receive mode, this bit is set by software to indicate that the next receiving byte will be the packet
error checking (PEC) data.
In master receive mode, after completion of CRC generation on the received PEC data, an
acknowledge signal is sent if MMTXAK = 0; no acknowledge is sent If MMTXAK = 1.
In slave receive mode, no acknowledge signal is sent if a CRC error is detected on the received PEC
data. If no CRC error is detected, an acknowledge signal is sent if MMTXAK = 0; no acknowledge is
sent If MMTXAK = 1.
Address:
$0049
Bit 7
654321
Bit 0
Read:
MMEN
MMIEN
00
MMTXAK REPSEN MMCRCBYTE
0
Write:
MMCLRBB
Reset:
00000000
= Unimplemented
Figure 14-5. MMIIC Control Register 1 (MMCR1)
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PDF描述
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參數(shù)描述
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MC908AP32CFBE 功能描述:8位微控制器 -MCU MCU 32K FLASH 10 BIT ADC RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風格:SMD/SMT
MC908AP32CFBER 功能描述:8位微控制器 -MCU MCU 32K FLASH 10 BIT ADC RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風格:SMD/SMT
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