參數(shù)資料
型號： MC908EY16ACFJE
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PQFP32
封裝： 7 X 7 MM, 1.40 MM HEIGHT, 0.80 MM HEIGHT, MS-026BBA, LQFP-32
文件頁數(shù)： 11/292頁
文件大?。?/td> 3482K
代理商： MC908EY16ACFJE
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MC68HC908EY16A MC68HC908EY8A Data Sheet, Rev. 2
108
Freescale Semiconductor
DDIV3:DDIV0 — ICG DCO Divider Control Bits
These bits indicate the number of divide-by-twos (DDIV) that follow the digitally controlled oscillator.
When ICGON is set, DDIV is controlled by the digital loop filter. The range of valid values for DDIV is
from $0 to $9. Values of $A through $F are interpreted the same as $9. Since the DCO is active during
reset, reset has no effect on DSTG and the value may vary.
8.7.7 ICG DCO Stage Register
DSTG7:DSTG0 — ICG DCO Stage Control Bits
These bits indicate the number of stages (above the minimum) in the digitally controlled oscillator. The
total number of stages is approximately equal to $1FF, so changing DSTG from $00 to $FF will
approximately double the period. Incrementing DSTG will increase the period (decrease the
frequency) by 0.202 percent to 0.368 percent (decrementing has the opposite effect). DSTG cannot
be written when ICGON is set to prevent inadvertent frequency shifting. When ICGON is set, DSTG is
controlled by the digital loop filter. Since the DCO is active during reset, reset has no effect on DSTG
and the value may vary.
Address: $003A
Bit 7
654321
Bit 0
Read:
DSTG7
DSTG6
DSTG5
DSTG4
DSTG3
DSTG2
DSTG1
DSTG0
Write:
RRRRRRRR
Reset:
Unaffected by reset
R= Reserved
Figure 8-15. ICG DCO Stage Control Register (ICGDSR)
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