參數(shù)資料
型號： MC908GZ48CFAE
廠商： Freescale Semiconductor
文件頁數(shù)： 65/352頁
文件大?。?/td> 0K
描述： IC MCU 48K FLASH 8MHZ 48-LQFP
標準包裝： 250
系列： HC08
核心處理器： HC08
芯體尺寸： 8-位
速度： 8MHz
連通性： CAN，SCI，SPI
外圍設備： LVD，POR，PWM
輸入/輸出數(shù)： 37
程序存儲器容量： 48KB（48K x 8）
程序存儲器類型： 閃存
RAM 容量： 1.5K x 8
電壓 - 電源 (Vcc/Vdd)： 3 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 24x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 85°C
封裝/外殼： 48-LQFP
包裝： 托盤
產(chǎn)品目錄頁面： 726 (CN2011-ZH PDF)
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Programmer’s Model of Control Registers
MC68HC908GZ60 MC68HC908GZ48 MC68HC908GZ32 Data Sheet, Rev. 6
Freescale Semiconductor
157
SFTRES — Soft Reset
When this bit is set by the CPU, the MSCAN08 immediately enters the soft reset state. Any ongoing
transmission or reception is aborted and synchronization to the bus is lost.
The following registers enter and stay in their hard reset state:
CMCR0, CRFLG, CRIER, CTFLG, and CTCR.
The registers CMCR1, CBTR0, CBTR1, CIDAC, CIDAR0–CIDAR3, and CIDMR0–CIDMR3 can only
be written by the CPU when the MSCAN08 is in soft reset state. The values of the error counters are
not affected by soft reset.
When this bit is cleared by the CPU, the MSCAN08 tries to synchronize to the CAN bus. If the
MSCAN08 is not in bus-off state, it will be synchronized after 11 recessive bits on the bus; if the
MSCAN08 is in bus-off state, it continues to wait for 128 occurrences of 11 recessive bits.
Clearing SFTRES and writing to other bits in CMCR0 must be in separate instructions.
1 = MSCAN08 in soft reset state
0 = Normal operation
12.13.2 MSCAN08 Module Control Register 1
LOOPB — Loop Back Self-Test Mode
When this bit is set, the MSCAN08 performs an internal loop back which can be used for self-test
operation: the bit stream output of the transmitter is fed back to the receiver internally. The CANRX
input pin is ignored and the CANTX output goes to the recessive state (1). The MSCAN08 behaves as
it does normally when transmitting and treats its own transmitted message as a message received
from a remote node. In this state the MSCAN08 ignores the bit sent during the ACK slot of the CAN
frame Acknowledge field to insure proper reception of its own message. Both transmit and receive
interrupts are generated.
1 = Activate loop back self-test mode
0 = Normal operation
WUPM — Wakeup Mode
This flag defines whether the integrated low-pass filter is applied to protect the MSCAN08 from
1 = MSCAN08 will wakeup the CPU only in cases of a dominant pulse on the bus which has a length
of at least twup.
0 = MSCAN08 will wakeup the CPU after any recessive-to-dominant edge on the CAN bus.
Address:
$0501
Bit 7
654321
Bit 0
Read:
00000
LOOPB
WUPM
CLKSRC
Write:
Reset:
00000000
= Unimplemented
Figure 12-17. Module Control Register (CMCR1)
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PDF描述
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MC908GZ48MFA 制造商:FREESCALE 制造商全稱:Freescale Semiconductor, Inc 功能描述:Microcontrollers
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