參數(shù)資料
型號(hào)： MC908MR16VFUE
廠商： Freescale Semiconductor
文件頁(yè)數(shù)： 6/282頁(yè)
文件大小： 0K
描述： IC MCU 16K FLASH 8MHZ 64-QFP
標(biāo)準(zhǔn)包裝： 84
系列： HC08
核心處理器： HC08
芯體尺寸： 8-位
速度： 8MHz
連通性： SCI，SPI
外圍設(shè)備： LVD，POR，PWM
輸入/輸出數(shù)： 44
程序存儲(chǔ)器容量： 16KB（16K x 8）
程序存儲(chǔ)器類(lèi)型： 閃存
RAM 容量： 768 x 8
電壓 - 電源 (Vcc/Vdd)： 4.5 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 10x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 105°C
封裝/外殼： 64-QFP
包裝： 托盤(pán)
產(chǎn)品目錄頁(yè)面： 725 (CN2011-ZH PDF)
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Port A
MC68HC908MR32 MC68HC908MR16 Data Sheet, Rev. 6.1
Freescale Semiconductor
103
10.2 Port A
Port A is an 8-bit, general-purpose, bidirectional I/O port.
10.2.1 Port A Data Register
The port A data register (PTA) contains a data latch for each of the eight port A pins.
PTA[7:0] — Port A Data Bits
These read/write bits are software programmable. Data direction of each port A pin is under the control
of the corresponding bit in data direction register A. Reset has no effect on port A data.
10.2.2 Data Direction Register A
Data direction register A (DDRA) determines whether each port A pin is an input or an output. Writing a
logic 1 to a DDRA bit enables the output buffer for the corresponding port A pin; a logic 0 disables the
output buffer.
DDRA[7:0] — Data Direction Register A Bits
These read/write bits control port A data direction. Reset clears DDRA[7:0], configuring all port A pins
as inputs.
1 = Corresponding port A pin configured as output
0 = Corresponding port A pin configured as input
NOTE
Avoid glitches on port A pins by writing to the port A data register before
changing data direction register A bits from 0 to 1.
Figure 10-4 shows the port A I/O logic.
Address:
$0000
Bit 7
654321
Bit 0
Read:
PTA7
PTA6
PTA5
PTA4
PTA3
PTA2
PTA1
PTA0
Write:
Reset:
Unaffected by reset
Figure 10-2. Port A Data Register (PTA)
Address:
$0004
Bit 7
654321
Bit 0
Read:
DDRA7
DDRA6
DDRA5
DDRA4
DDRA3
DDRA2
DDRA1
DDRA0
Write:
Reset:
00000000
Figure 10-3. Data Direction Register A (DDRA)
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