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參數(shù)資料
| 型號： | MC908QY8CDTE |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 169/232頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC MCU 8BIT 8K FLASH 16-TSSOP |
| 標(biāo)準(zhǔn)包裝： | 96 |
| 系列： | HC08 |
| 核心處理器： | HC08 |
| 芯體尺寸： | 8-位 |
| 速度： | 8MHz |
| 外圍設(shè)備： | LVD，POR，PWM |
| 輸入/輸出數(shù)： | 13 |
| 程序存儲器容量： | 8KB（8K x 8） |
| 程序存儲器類型： | 閃存 |
| RAM 容量： | 256 x 8 |
| 電壓 - 電源 (Vcc/Vdd)： | 2.7 V ~ 5.5 V |
| 數(shù)據(jù)轉(zhuǎn)換器： | A/D 4x10b |
| 振蕩器型： | 外部 |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 16-TSSOP（0.173"，4.40mm 寬） |
| 包裝： | 管件 |
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Functional Description
MC68HC908QB8 Data Sheet, Rev. 3
Freescale Semiconductor
39
Figure 3-2. ADC10 Block Diagram
The ADC10 can perform an analog-to-digital conversion on one of the software selectable channels. The
output of the input multiplexer (ADVIN) is converted by a successive approximation algorithm into a 10-bit
digital result. When the conversion is completed, the result is placed in the data registers (ADRH and
ADRL). In 8-bit mode, the result is rounded to 8 bits and placed in ADRL. The conversion complete flag
is then set and an interrupt is generated if the interrupt has been enabled.
3.3.1 Clock Select and Divide Circuit
The clock select and divide circuit selects one of three clock sources and divides it by a configurable value
to generate the input clock to the converter (ADCK). The clock can be selected from one of the following
sources:
The asynchronous clock source (ACLK) — This clock source is generated from a dedicated clock
source which is enabled when the ADC10 is converting and the clock source is selected by setting
the ACLKEN bit. When the ADLPC bit is clear, this clock operates from 1–2 MHz; when ADLPC is
set it operates at 0.5–1 MHz. This clock is not disabled in STOP and allows conversions in stop
mode for lower noise operation.
Alternate Clock Source — This clock source is equal to the external oscillator clock or a four times
the bus clock. The alternate clock source is MCU specific, see 3.1 Introduction to determine source
and availability of this clock source option. This clock is selected when ADICLK and ACLKEN are
both low.
The bus clock — This clock source is equal to the bus frequency. This clock is selected when
ADICLK is high and ACLKEN is low.
AD0
ADn
VREFH
VREFL
ADVIN
ADC
H
CONTROL SEQUENCER
IN
IT
IAL
IZE
SAMPLE
CONVERT
TR
ANSFER
ABORT
ADCK
BUS CLOCK
ALTERNATE CLOCK SOURCE
ADICLK
ADIV
ACLK
ADCO
ADSCR
AD
LS
M
P
AD
LP
C
MODE
COMPLETE
DATA REGISTERS ADRH:ADRL
SAR CONVERTER
AIEN
COCO
INTERRUPT
AIEN
COCO
1
2
1
2
MCU STOP
ADHWT
ADCLK
ACLKEN
ASYNC
CLOCK
GENERATOR
CLOCK
DIVIDE
相關(guān)PDF資料 |
PDF描述 |
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| MC908QY8VDWE | 功能描述:8位微控制器 -MCU NITRON 8K FLASH 908QY8 RoHS:否 制造商:Silicon Labs 核心:8051 處理器系列:C8051F39x 數(shù)據(jù)總線寬度:8 bit 最大時鐘頻率:50 MHz 程序存儲器大小:16 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:1.8 V to 3.6 V 工作溫度范圍:- 40 C to + 105 C 封裝 / 箱體:QFN-20 安裝風(fēng)格:SMD/SMT |
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