參數(shù)資料
型號(hào)： MC912XDP512F0VFVR
廠商： FREESCALE SEMICONDUCTOR INC
元件分類(lèi)： 微控制器/微處理器
英文描述： 16-BIT, FLASH, 40 MHz, MICROCONTROLLER, PQFP144
封裝： 20 X 20 MM, QFP-144.
文件頁(yè)數(shù)： 254/1350頁(yè)
文件大?。?/td> 7418K
代理商： MC912XDP512F0VFVR
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Chapter 29 128 Kbyte Flash Module (S12XFTX128K1V1)
MC9S12XDP512 Data Sheet, Rev. 2.17
1226
Freescale Semiconductor
29.4.3
Illegal Flash Operations
The ACCERR ag will be set during the command write sequence if any of the following illegal steps are
performed, causing the command write sequence to immediately abort:
1. Writing to a Flash address before initializing the FCLKDIV register.
2. Writing a byte or misaligned word to a valid Flash address.
3. Starting a command write sequence while a data compress operation is active.
4. Starting a command write sequence while a sector erase abort operation is active.
5. Writing to any Flash register other than FCMD after writing to a Flash address.
6. Writing a second command to the FCMD register in the same command write sequence.
7. Writing an invalid command to the FCMD register.
8. When security is enabled, writing a command other than mass erase to the FCMD register when
the write originates from a non-secure memory location or from the Background Debug Mode.
9. Writing to a Flash address after writing to the FCMD register.
10. Writing to any Flash register other than FSTAT (to clear CBEIF) after writing to the FCMD
register.
11. Writing a 0 to the CBEIF ag in the FSTAT register to abort a command write sequence.
The ACCERR ag will not be set if any Flash register is read during a valid command write sequence.
The ACCERR ag will also be set if any of the following events occur:
1. Launching the sector erase abort command while a sector erase operation is active which results in
the early termination of the sector erase operation (see Section 29.4.2.6, “Sector Erase Abort
2. The MCU enters stop mode and a program or erase operation is in progress. The operation is
aborted immediately and any pending command is purged (see Section 29.5.2, “Stop Mode”).
If the Flash memory is read during execution of an algorithm (CCIF = 0), the read operation will return
invalid data and the ACCERR ag will not be set.
If the ACCERR ag is set in the FSTAT register, the user must clear the ACCERR ag before starting
another command write sequence (see Section 29.3.2.6, “Flash Status Register (FSTAT)”).
The PVIOL ag will be set after the command is written to the FCMD register during a command write
sequence if any of the following illegal operations are attempted, causing the command write sequence to
immediately abort:
1. Writing the program command if an address written in the command write sequence was in a
protected area of the Flash memory
2. Writing the sector erase command if an address written in the command write sequence was in a
protected area of the Flash memory
3. Writing the mass erase command to a Flash block while any Flash protection is enabled in the
block
If the PVIOL ag is set in the FSTAT register, the user must clear the PVIOL ag before starting another
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