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參數(shù)資料
| 型號(hào)： | MC9328MX21VM |
| 廠商： | Freescale Semiconductor |
| 文件頁數(shù)： | 94/100頁 |
| 文件大小： | 0K |
| 描述： | IC MCU I.MX21 266MHZ 289-MAPBGA |
| 標(biāo)準(zhǔn)包裝： | 90 |
| 系列： | i.MX21 |
| 核心處理器： | ARM9 |
| 芯體尺寸： | 32-位 |
| 速度： | 266MHz |
| 連通性： | 1 線，EBI/EMI，I²C，IrDA，MMC，智能卡，SPI，SSI，UART/USART，USB OTG |
| 外圍設(shè)備： | DMA，I²S，LCD，POR，PWM，WDT |
| 輸入/輸出數(shù)： | 192 |
| 程序存儲(chǔ)器類型： | ROMless |
| 電壓 - 電源 (Vcc/Vdd)： | 1.45 V ~ 3.3 V |
| 振蕩器型： | 外部 |
| 工作溫度： | 0°C ~ 70°C |
| 封裝/外殼： | 289-LFBGA |
| 包裝： | 托盤 |
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Specifications
MC9328MX21 Technical Data, Rev. 3.4
Freescale Semiconductor
93
Figure 81. Sensor Output Data on Pixel Clock Falling Edge
CSI Latches Data on Pixel Clock Rising Edge
Figure 82. Sensor Output Data on Pixel Clock Rising Edge
CSI Latches Data on Pixel Clock Falling Edge
HCLK = AHB System Clock, THCLK = Period for HCLK, TP = Period of CSI_PIXCLK
Table 45. Gated Clock Mode Timing Parameters
Number
Parameter
Minimum
Maximum
Unit
1
csi_vsync to csi_hsync
9 * THCLK
–ns
2
csi_hsync to csi_pixclk
3
(TP/2) - 3
ns
3
csi_d setup time
1
–
ns
4
csi_d hold time
1
–
ns
5
csi_pixclk high time
THCLK
–ns
6
csi_pixclk low time
THCLK
–ns
7
csi_pixclk frequency
0
HCLK / 2
MHz
1
3
6
5
VSYNC
HSYNC
PIXCLK
DATA[7:0]
Valid Data
4
7
2
1
3
6
5
VSYNC
HSYNC
PIXCLK
DATA[7:0]
Valid Data
4
7
2
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| MCIMX357DJQ5CR2 | MULTIMEDIA PROCESSOR 400-MAPBGA |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| MC9328MX21VM | 制造商:Freescale Semiconductor 功能描述:Microprocessor |
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