參數(shù)資料
型號(hào)： MC9328MXSCVF10R2
廠商： FREESCALE SEMICONDUCTOR INC
元件分類(lèi)： 微控制器/微處理器
英文描述： 32-BIT, 100 MHz, MICROPROCESSOR, PBGA225
封裝： 13 X 13 MM, PLASTIC, BGA-225
文件頁(yè)數(shù)： 48/72頁(yè)
文件大?。?/td> 1411K
代理商： MC9328MXSCVF10R2
MC9328MXS Advance Information, Rev. 0
52
Freescale Semiconductor
Specifications
Figure 42. Slave SPI Timing Diagram FIFO Advanced by SS Rising Edge
3.11 LCD Controller
This section includes timing diagrams for the LCD controller. For detailed timing diagrams of the LCD controller
with various display configurations, refer to the LCD controller chapter of the i.MX Reference Manual.
Figure 43. SCLK to LD Timing Diagram
Table 22. Timing Parameter Table for Figure 38 through Figure 42
Ref No.
Parameter
3.0 ± 0.3 V
Unit
Minimum
Maximum
1
SPI_RDY to SS output low
2T1
1.
T = CSPI system clock period (PERCLK2).
–ns
2SS output low to first SCLK edge
3 Tsclk2
2.
Tsclk = Period of SCLK.
–ns
3
Last SCLK edge to SS output high
2 Tsclk
–
ns
4SS output high to SPI_RDY low
0
–
ns
5SS output pulse width
Tsclk + WAIT 3
3.
WAIT = Number of bit clocks (SCLK) or 32.768 kHz clocks per Sample Period Control Register.
–ns
6SS input low to first SCLK edge
T
–
ns
7SS input pulse width
T
–
ns
Table 23. LCDC SCLK Timing Parameter Table
Ref
No.
Parameter
3.0 ± 0.3 V
Unit
Minimum
Maximum
1
SCLK to LD valid
–
2
ns
6
7
SS (input)
SCLK, MOSI, MISO
1
LSCLK
LD[15:0]
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PDF描述
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