參數(shù)資料
型號： MC9S08DN32CLC
廠商： FREESCALE SEMICONDUCTOR INC
元件分類： 微控制器/微處理器
英文描述： 8-BIT, FLASH, 16 MHz, MICROCONTROLLER, PQFP32
封裝： 7 X 7 MM, 1.40 MM HEIGHT, 0.80 MM PITCH, ROHS COMPLIANT, MS-026BBA, LQFP-32
文件頁數(shù)： 14/354頁
文件大?。?/td> 3678K
代理商： MC9S08DN32CLC
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Chapter 7 Central Processor Unit (S08CPUV3)
MC9S08DN60 Series Data Sheet, Rev 2
110
Freescale Semiconductor
Figure 7-2. Condition Code Register
Table 7-1. CCR Register Field Descriptions
Field
Description
7
V
Two’s Complement Overow Flag — The CPU sets the overow ag when a two’s complement overow occurs.
The signed branch instructions BGT, BGE, BLE, and BLT use the overow ag.
0 No overow
1 Overow
4
H
Half-Carry Flag — The CPU sets the half-carry ag when a carry occurs between accumulator bits 3 and 4 during
an add-without-carry (ADD) or add-with-carry (ADC) operation. The half-carry ag is required for binary-coded
decimal (BCD) arithmetic operations. The DAA instruction uses the states of the H and C condition code bits to
automatically add a correction value to the result from a previous ADD or ADC on BCD operands to correct the
result to a valid BCD value.
0 No carry between bits 3 and 4
1 Carry between bits 3 and 4
3
I
Interrupt Mask Bit — When the interrupt mask is set, all maskable CPU interrupts are disabled. CPU interrupts
are enabled when the interrupt mask is cleared. When a CPU interrupt occurs, the interrupt mask is set
automatically after the CPU registers are saved on the stack, but before the rst instruction of the interrupt service
routine is executed.
Interrupts are not recognized at the instruction boundary after any instruction that clears I (CLI or TAP). This
ensures that the next instruction after a CLI or TAP will always be executed without the possibility of an intervening
interrupt, provided I was set.
0 Interrupts enabled
1 Interrupts disabled
2
N
Negative Flag — The CPU sets the negative ag when an arithmetic operation, logic operation, or data
manipulation produces a negative result, setting bit 7 of the result. Simply loading or storing an 8-bit or 16-bit value
causes N to be set if the most signicant bit of the loaded or stored value was 1.
0 Non-negative result
1 Negative result
1
Z
Zero Flag — The CPU sets the zero ag when an arithmetic operation, logic operation, or data manipulation
produces a result of 0x00 or 0x0000. Simply loading or storing an 8-bit or 16-bit value causes Z to be set if the
loaded or stored value was all 0s.
0 Non-zero result
1 Zero result
0
C
Carry/Borrow Flag — The CPU sets the carry/borrow ag when an addition operation produces a carry out of bit
7 of the accumulator or when a subtraction operation requires a borrow. Some instructions — such as bit test and
branch, shift, and rotate — also clear or set the carry/borrow ag.
0 No carry out of bit 7
1 Carry out of bit 7
CONDITION CODE REGISTER
CARRY
ZERO
NEGATIVE
INTERRUPT MASK
HALF-CARRY (FROM BIT 3)
TWO’S COMPLEMENT OVERFLOW
70
CCR
C
V1 1 H
I
N Z
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PDF描述
MC9S08DN32MLF 8-BIT, FLASH, 16 MHz, MICROCONTROLLER, PQFP48
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MC9S08DN60CLH 8-BIT, FLASH, 16 MHz, MICROCONTROLLER, PQFP64
MC9S08DN48CLF 8-BIT, FLASH, 16 MHz, MICROCONTROLLER, PQFP48
MC9S08DN60MLH 8-BIT, FLASH, 16 MHz, MICROCONTROLLER, PQFP64
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參數(shù)描述
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