參數(shù)資料
型號(hào)： MC9S08GT16ACFDE
廠商： FREESCALE SEMICONDUCTOR INC
元件分類(lèi)： 微控制器/微處理器
英文描述： 16-BIT, FLASH, 40 MHz, MICROCONTROLLER, QCC48
封裝： 7 X 7 MM, 1 MM HEIGHT, 0.50 MM PITCH, ROHS COMPLIANT, MO-220VKKD-2, QFN-48
文件頁(yè)數(shù)： 145/300頁(yè)
文件大?。?/td> 1606K
代理商： MC9S08GT16ACFDE
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Analog-to-Digital Converter (S08ATDV3)
MC9S08GT16A/GT8A Data Sheet, Rev. 1
Freescale Semiconductor
229
14.3.3
ATD Result Data (ATDRH, ATDRL)
For left-justied mode, result data bits 9–2 map onto bits 7–0 of ATDRH, result data bits 1 and 0 map onto
ATDRL bits 7 and 6, where bit 7 of ATDRH is the most signicant bit (MSB).
Figure 14-7. Left-Justied Mode
For right-justied mode, result data bits 9 and 8 map onto bits 1 and 0 of ATDRH, result data bits 7–0 map
onto ATDRL bits 7–0, where bit 1 of ATDRH is the most signicant bit (MSB).
Figure 14-8. Right-Justied Mode
The ATD 10-bit conversion results are stored in two 8-bit result registers, ATDRH and ATDRL. The result
data is formatted either left or right justied where the format is selected using the DJM control bit in the
ATDC register. The 10-bit result data is mapped either between ATDRH bits 7–0 and ATDRL bits 7–6 (left
justied), or ATDRH bits 1–0 and ATDRL bits 7–0 (right justied).
For 8-bit conversions, the 8-bit result is always located in ATDRH bits 7–0, and the ATDRL bits read 0.
For 10-bit conversions, the six unused bits always read 0.
The ATDRH and ATDRL registers are read-only.
14.3.4
ATD Pin Enable (ATDPE)
7
6
5
4
3
2
1
0
7
6
5
4
3
2
1
0
9
0
ATD1RH
ATD1RL
7
6
5
4
3
2
1
0
7
6
5
4
3
2
1
0
9
0
ATD1RH
ATD1RL
76543210
R
ATDPE7
ATDPE6
ATDPE5
ATDPE4
ATDPE3
ATDPE2
ATDPE1
ATDPE0
W
Reset
00000000
Figure 14-9. ATD Pin Enable Register (ATDPE)
Table 14-7. ATDSC Register Field Descriptions
Field
Description
7:0
ATDPE[7:0]
ATD Pin 7–0 Enables — The ATD pin enable register allows the pins dedicated to the ATD module to be
congured for ATD usage. A write to this register will abort the current conversion but will not initiate a new
conversion. If the ATDPEx bit is 0 (disabled for ATD usage) but the corresponding analog input channel is
selected via the ATDCH bits, the ATD will not convert the analog input but will instead convert VREFL placing
zeroes in the ATD result registers.
0 Pin disabled for ATD usage.
1 Pin enabled for ATD usage.
RESULT
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PDF描述
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