參數(shù)資料
型號(hào)： MC9S08SF4MTJ
廠商： Freescale Semiconductor
文件頁(yè)數(shù)： 10/30頁(yè)
文件大小： 0K
描述： MCU 8BIT 4K FLASH 20-TSSOP
標(biāo)準(zhǔn)包裝： 75
系列： S08
核心處理器： S08
芯體尺寸： 8-位
速度： 40MHz
連通性： I²C
外圍設(shè)備： LVD，POR，PWM，WDT
輸入/輸出數(shù)： 18
程序存儲(chǔ)器容量： 4KB（4K x 8）
程序存儲(chǔ)器類型： 閃存
RAM 容量： 128 x 8
電壓 - 電源 (Vcc/Vdd)： 2.7 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 8x10b
振蕩器型： 外部
工作溫度： -40°C ~ 125°C
封裝/外殼： 20-TSSOP（0.173"，4.40mm 寬）
包裝： 管件
MC9S08SF4 Series MCU Data Sheet, Rev. 4
AC Characteristics
Freescale Semiconductor
18
3.9.1
Control Timing
Figure 14. Reset Timing
Figure 15. IRQ/KBIPx Timing
Table 9. Control Timing
Parameter
Symbol
Minimum
Typical1
1 Data in Typical column was characterized at 5.0 V, 25
C.
Maximum
Unit
Bus frequency (tcyc = 1/fBus)fBus
1—
20
MHz
External reset pulse width2
2 This is the shortest pulse that is guaranteed to be recognized.
textrst
100
—
ns
IRQ pulse width
Asynchronous path2
Synchronous path3
3 This is the minimum pulse width that is guaranteed to pass through the pin synchronization circuitry. Shorter pulses may or
may not be recognized. In stop mode, the synchronizer is bypassed so shorter pulses can be recognized in that case.
tILIH, tIHIL
100
1.5 tcyc
——
ns
KBIPx pulse width
Asynchronous path2
Synchronous path3
tILIH, tIHIL
100
1.5 tcyc
——
ns
Port rise and fall time (load = 50 pF)4
Slew rate control disabled (PTxSE = 0)
Slew rate control enabled (PTxSE = 1)
4 Timing is shown with respect to 20% V
DD and 80% VDD levels. Temperature range –40 C to 125 C.
tRise, tFall
—
3
30
—
ns
BKGD/MS setup time after issuing background debug force
reset to enter user or BDM modes
tMSSU
500
—
ns
BKGD/MS hold time after issuing background debug force
reset to enter user or BDM modes 5
5 To enter BDM mode following a POR, BKGD/MS should be held low during the power-up and for a hold time of t
MSH after VDD
rises above VLVD.
tMSH
100
—
s
textrst
RESET PIN
tIHIL
IRQ/KBIPx
tILIH
IRQ/KBIPx
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