參數(shù)資料
型號： MC9S12C128VFAE
廠商： Freescale Semiconductor
文件頁數(shù)： 110/690頁
文件大?。?/td> 0K
描述： IC MCU 128K FLASH 25MHZ 48-LQFP
標準包裝： 250
系列： HCS12
核心處理器： HCS12
芯體尺寸： 16-位
速度： 25MHz
連通性： CAN，EBI/EMI，SCI，SPI
外圍設備： POR，PWM，WDT
輸入/輸出數(shù)： 31
程序存儲器容量： 128KB（128K x 8）
程序存儲器類型： 閃存
RAM 容量： 4K x 8
電壓 - 電源 (Vcc/Vdd)： 2.35 V ~ 5.5 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 8x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 105°C
封裝/外殼： 48-LQFP
包裝： 托盤
產(chǎn)品目錄頁面： 731 (CN2011-ZH PDF)
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Chapter 7 Debug Module (DBGV1) Block Description
198
MC9S12C-Family / MC9S12GC-Family
Freescale Semiconductor
Rev 01.24
7.3.2.1
Debug Control Register 1 (DBGC1)
NOTE
All bits are used in DBG mode only.
NOTE
This register cannot be written if BKP mode is enabled (BKABEN in
DBGC2 is set).
1. The DBG module is designed for backwards compatibility to existing BKP modules. Register and bit names have changed from
the BKP module. This column shows the DBG register name, as well as the BKP register name for reference.
2. Comparator C can be used to enhance the BKP mode by providing a third breakpoint.
Module Base + 0x0020
Starting address location affected by INITRG register setting.
76543210
R
DBGEN
ARM
TRGSEL
BEGIN
DBGBRK
0
CAPMOD
W
Reset
0
00000
= Unimplemented or Reserved
Figure 7-4. Debug Control Register (DBGC1)
Table 7-3. DBGC1 Field Descriptions
Field
Description
7
DBGEN
DBG Mode Enable Bit — The DBGEN bit enables the DBG module for use in DBG mode. This bit cannot be
set if the MCU is in secure mode.
0 DBG mode disabled
1 DBG mode enabled
6
ARM
Arm Bit — The ARM bit controls whether the debugger is comparing and storing data in the trace buffer. See
0 Debugger unarmed
1 Debugger armed
Note: This bit cannot be set if the DBGEN bit is not also being set at the same time. For example, a write of 01
to DBGEN[7:6] will be interpreted as a write of 00.
5
TRGSEL
Trigger Selection Bit — The TRGSEL bit controls the triggering condition for comparators A and B in DBG
mode. It serves essentially the same function as the TAGAB bit in the DBGC2 register does in BKP mode. See
Section 7.4.2.1.2, “Trigger Selection,” for more information. TRGSEL may also determine the type of breakpoint
based on comparator A and B if enabled in DBG mode (DBGBRK = 1). Please refer to Section 7.4.3.1,
0 Trigger on any compare address match
1 Trigger before opcode at compare address gets executed (tagged-type)
4
BEGIN
Begin/End Trigger Bit — The BEGIN bit controls whether the trigger begins or ends storing of data in the trace
more details.
0 Trigger at end of stored data
1 Trigger before storing data
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PDF描述
M22-1900046 CONN JUMPER SHORTING TIN BLACK
MC9S12XDT256CAA IC MCU 256K FLASH 80-QFP
MC9S12E256CPVE IC MCU 256K FLASH 25MHZ 112-LQFP
390088-3 BLUE HSG WITH 30AU CONTACT
1-880584-2 SHUNT CONN. ASS'Y
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參數(shù)描述
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MC9S12C32CFAE16 功能描述:16位微控制器 - MCU GOLDFISH RoHS:否 制造商:Texas Instruments 核心:RISC 處理器系列:MSP430FR572x 數(shù)據(jù)總線寬度:16 bit 最大時鐘頻率:24 MHz 程序存儲器大小:8 KB 數(shù)據(jù) RAM 大小:1 KB 片上 ADC:Yes 工作電源電壓:2 V to 3.6 V 工作溫度范圍:- 40 C to + 85 C 封裝 / 箱體:VQFN-40 安裝風格:SMD/SMT
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